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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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24. ウォッチドッグ・タイマー
ウォッチドッグ・タイマーは、ソフトウェアまたはシステムに関連する問題によって発生するシステム・ロックアップからの回復に使用することができるペリフェラルです。ハード・プロセッサー・システム (HPS) は、レベル4 (L4) ペリフェラル・バスに接続される4つのプログラミング可能なウォッチドッグ・タイマーを提供します。ウォッチドッグ・タイマーは、 Synopsys® DesignWare* APB Watchdog Timers (DW_apb_wdt 1.08a) ペリフェラルのインスタンスです。55
Cortex-A53 MPCoreプロセッサーは、2つの追加ウォッチドッグ・タイマーを提供します。
セクションの内容
ウォッチドッグ・タイマーの機能
ウォッチドッグ・タイマーのブロック図とシステムへの統合
ウォッチドッグ・タイマーの機能の説明
ウォッチドッグ・タイマーのプログラミング・モデル
ウォッチドッグ・タイマーのアドレスマップとレジスターの定義
55 一部 © 2017 Synopsys, Inc.であり、許可を得て使用しています。無断での引用、転載を禁じます。Synopsys & DesignWareはSynopsys, Inc.の登録商標です。すべてのドキュメントは「現状」のまま提供され、いかなる保証も伴いません。Synopsysは、商品性、特定の目的への適合性、非侵害における黙示の保証、および、取引の過程または取引での用途によって生じるあらゆる保証を含むすべての保証 (明示、黙示、その他を問わない) を明示的に否認します。
†短剣記号 (†) が付いている段落は、Synopsys独自のものです。許可を得て使用しています。