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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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24.3.1. ウォッチドッグ・タイマーのカウンター
各ウォッチドッグタイマーは、プログラミング可能なリトルエンディアンのダウンカウンターであり、クロックサイクルごとに1ずつ減少します。ウォッチドッグ・タイマーは、16の固定タイムアウト期間の値をサポートしており、ソフトウェアで必要なタイムアウト期間を選択します。タイムアウト期間は2<n> l4_sys_free_clkクロック周期です。このnは、16から31までの整数です。
ソフトウェアでは定期的にタイマーを再起動 (再起動タイムアウト期間の値255がカウンターに再ロードされる) し、システムが正常に機能していることを示す必要があります。ソフトウェアでは、再起動レジスターに書き込むことにより、随時カウンターを再ロードすることができます。カウンターが0に達した場合は、ウォッチドッグ・タイマーがタイムアウトしています。これは回復不能なエラーが発生したことを示しており、システムのリセットが必要です。
ソフトウェアで、ウォッチドッグ・タイマーを次の出力応答モードのいずれかにコンフィグレーションします。
- タイムアウト時にリセット要求を生成する。
- タイムアウト時に割り込み要求をアサートし、ウォッチドッグ・タイマーを再起動する。ソフトウェアでは、2回目のタイムアウトが発生する前に割り込みを処理し、ウォッチドッグ・タイマーをリセットする必要があります。そうでない場合は、リセット要求が生成されます。
ウォッチドッグ・カウンターが0に達すると同時に再起動が発生した場合、割り込みは生成されません。
注: ウォッチドッグ・タイマーが0に達し、リセットまたは割り込みが生成されると、カウンターはリセットされてカウントを続けます。