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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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15.4.8.3.3. MAP10使用時の制限
MAP10コマンドは、次のように使用します。
- MAP10コマンドは、消去、コピーバック、ロック、ロック解除などのコマンドをコントローラーに発行するために使用します。
- MAP10パイプライン・コマンドは、デバイスブロック境界内のフラッシュデバイスの連続する複数ページの読み出しまたは書き込みにも使用されます。ホストは、最初にMAP10パイプライン読み出しまたは書き込みコマンドを発行し、その後、MAP01コマンドを発行して実際のデータ転送を実行する必要があります。フラッシュ・コントローラーは、読み出しを行う複数の連続ページを認識します。そのため、MAP10パイプライン読み出しまたは書き込みコマンドでは、キャッシュやマルチプレーンなどの高性能コマンドを使用するように、NANDフラッシュ・コントローラーに指示します。ページはブロック境界を越えてはいけません。ブロック境界を超えた場合、フラッシュ・コントローラーはサポートされていないコマンド (unsup_cmd) 割り込みを生成し、コマンドをドロップします。
- 最大4つのパイプライン読み出しまたは書き込みコマンドを同時にNANDフラッシュ・コントローラーに発行することができます。
- NANDフラッシュ・コントローラーがMAP10パイプライン読み出しまたは書き込みコマンドを実行している際は、DMAを無効にする (dmaグループのdma_enableレジスターのflagビットを0に設定する) 必要があります。ホストはフラッシュ・コントローラーを介してフラッシュデバイスとのデータ転送を直接行っているため、DMAは無効になっている必要があります。