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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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7.3.5.3. FPGA-to-HPS CCUからメモリー (キャッシュ割り当てあり)
FPGA からHPS CCUへのインターフェイスはACE-Lite*です。このトランザクションはCCUを通過しますが、AxCACHEパラメーターに応じてキャッシュすることもキャッシュなしにすることもできます。トランザクションは、メモリー割り当てに応じて特権または非特権にすることができます。
注: メモリーはSDRAMまたはオンチップRAM (OCRAM) です。
キャッシュ割り当てのあるトランザクションを行う場合は、CCUによってコヒーレンシーが維持され、キャッシュへの割り当てが行われます。これは、コヒーレンシーを維持し、システムにおいて最小限のレイテンシーでデータを利用できるようにする場合に役立ちます。これにより、マスターはトランザクションごとに外部メモリーにアクセスすることがなくなります。
読み出し
- キャッシュヒットの場合、読み出しデータはキャッシュから返されます。
- キャッシュミスの場合、読み出しデータはメインメモリーから返され、キャッシュに割り当てられます (格納されます)。
属性 | 値 | 備考 |
---|---|---|
ARDOMAIN[1:0] | ’b01 | 内部共有可能 |
ARBAR[1:0] | ‘b00 | 通常のアクセス、バリアが考慮されます |
ARSNOOP[3:0] | ‘b0000 | ReadOnce |
ARCACHE[3:0] | ‘b1111 | Write-back Read-allocate |
AxUSER[7:0] | ‘b00000100 | 0x04 = CCU |
AxPROT[2:0] | ‘b001 | データアクセス、セキュアアクセス、特権アクセス |
AxLEN[7:0] | — |
バースト長
|
AxSIZE[2:0] | — | 転送のバイト数は、データバス幅と等しくなる必要があります |
AxBURST[1:0] | ‘b01または‘b10 | INCR (‘b01) またはWRAP (‘b10) にする必要があります |
AxLOCK[1:0] | ‘b00 | 通常のアクセスにする必要があります |
AxQOS | — | ドントケア |
書き込み
- キャッシュヒットの場合、書き込みデータはキャッシュに格納されます。
- キャッシュミスの場合、書き込みデータはキャッシュに割り当てられます (格納されます)。
属性 | 値 | 備考 |
---|---|---|
AWDOMAIN[1:0] | ’b01 | 内部共有可能 |
AWBAR[1:0] | ‘b00 | 通常のアクセス、バリアが考慮されます |
AWSNOOP[2:0] | ‘b000 | WriteUnique (WriteLineUniqueの場合は‘b001) |
AWCACHE[3:0] | ‘b1111 | Write-back Write-allocate |
AxUSER[7:0] | ‘b00000100 | 0x04 = CCU |
AxPROT[2:0] | ‘b001 | データアクセス、セキュアアクセス、特権アクセス |
AxLEN[7:0] | — |
バースト長
|
AxSIZE[2:0] | — | 転送のバイト数は、データバス幅と等しくなる必要があります |
AxBURST[1:0] | ‘b01または‘b10 | INCR (‘b01) またはWRAP (‘b10) にする必要があります |
AxLOCK[1:0] | ‘b00 | 通常のアクセスにする必要があります |
AxQOS | — | ドントケア |