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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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16.4.3. CIU
カード・インターフェイス・ユニット (CIU) は、BIUおよびSD/MMCカードまたはデバイスとインターフェイスします。ホスト・プロセッサーは、コマンド・パラメーターをSD/MMCコントローラーのBIUコントロール・レジスターに書き込みます。これらのパラメーターはその後、CIUに渡されます。コントロール・レジスターの値に応じて、CIUは、SD/MMCプロトコルに基づきSD/MMCコマンドとデータ・トラフィックをカードバス上で生成します。コントロール・レジスターの値はまた、コマンドとデータ・トラフィックがCE‑ATAカードに送信されるかを決定します。SD/MMCコントローラーは、それに応じてコマンドとデータパスを制御します。†
次に、CIUの動作の制約を説明します。†
- コマンドが発行されると、CIUは、読み出しステータスを確認する、もしくは転送を停止する場合にのみ別のコマンドを受け入れます。†
- 一度に発行できるデータ転送コマンドは1つのみです。†
- オープンエンドのカード書き込み動作中に、FIFOバッファーが空になったことでカードクロックが停止した場合、ソフトウェアはまずFIFOバッファーにデータを入れ、カードクロックを開始する必要があります。その後、SD/SDIO STOP_TRANSMISSION (CMD12) コマンドのみをカードに発行することができます。†
- SDIO/COMBOカードの転送中にカード機能が一時停止し、ソフトウェアで停止した転送を再開する場合は、FIFOバッファーをまずリセットし、新しいデータ転送コマンドのように、再開するコマンドを開始する必要があります。†
- カードデータ転送が進行中に、SD/SDIOカードのリセットコマンド (GO_IDLE_STATE、GO_INACTIVE_STATE、またはCMD52_reset) を発行する場合は、ソフトウェアでcmdレジスターのstop abort command (stop_abort_cmd) ビットを1に設定し、カード・リセット・コマンドの発行後にコントローラーがデータの転送を停止できるようにする必要があります。†
- カードの読み出し中に、FIFOバッファーがフルのためにカードクロックが停止した場合、ソフトウェアは少なくとも2つのFIFOバッファー位置を読み出し、カードクロックを開始する必要があります。†
- CE‑ATAカードデバイスの割り込みが有効になっている (ATAコントロール・レジスターのnIENビットが0に設定されている) 場合、保留中のRW_BLKコマンドが進行している際は、新しいRW_BLKコマンドを同じカードデバイスに送信しないでください。 (このドキュメントで使用されているRW_BLKコマンドは、CE‑ATA仕様で定義されているRW_MULTIPLE_BLOCK MMCコマンドです)。Command Completion Signal (CCS) を待機している間は、Command Completion Signal Disable (CCSD) コマンドのみを送信することができます。†
- CE‑ATAカードで割り込みが無効になっている (ATAコントロール・レジスターのnIENビットが1に設定されている) 場合は、同じカードデバイスには、ステータス情報を読み取る目的の新しいコマンドが許可されます。†
- オープンエンド転送は、CE‑ATAカードデバイスでサポートされていません。†
- send_auto_stop信号は、CE‑ATA転送でサポートされていません。ソフトウェアでcmdレジスターのsend_auto_stopビットを設定しないでください。†
CIUは、次の主要な機能ブロックで構成されます。†
- コマンドパス†
- データパス†
- クロック制御†