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1. インテル® Agilex™ ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアル改訂履歴
2. ハード・プロセッサー・システムの概要
3. Cortex-A53 MPCoreプロセッサー
4. キャッシュ・コヒーレンシー・ユニット
5. システムメモリー管理ユニット
6. システム・インターコネクト
7. ブリッジ
8. DMAコントローラー
9. オンチップRAM
10. ECC (エラー検出訂正) コントローラー
11. クロック・マネージャー
12. システム・マネージャー
13. リセット・マネージャー
14. ハード・プロセッサー・システムのI/Oピンの多重化
15. NANDフラッシュ・コントローラー
16. SD/MMCコントローラー
17. イーサネット・メディア・アクセス・コントローラー
18. USB 2.0 OTGコントローラー
19. SPIコントローラー
20. I2Cコントローラー
21. UARTコントローラー
22. 汎用I/Oインターフェイス
23. タイマー
24. ウォッチドッグ・タイマー
25. CoreSightのデバッグとトレース
A. ブートとコンフィグレーション
B. HPSを介したセキュア・デバイス・マネージャーQuad SPIフラッシュ・コントローラーへのアクセス
3.5.1. 例外レベル
3.5.2. 仮想化
3.5.3. メモリー管理ユニット
3.5.4. レベル1キャッシュ
3.5.5. レベル2メモリーシステム
3.5.6. スヌープ制御ユニット
3.5.7. 暗号化による拡張
3.5.8. NEONマルチメディア・プロセッシング・エンジン
3.5.9. 浮動小数点演算装置
3.5.10. ACEバス・インターフェイス
3.5.11. アボート処理
3.5.12. キャッシュ保護
3.5.13. 汎用割り込みコントローラー
3.5.14. 汎用タイマー
3.5.15. デバッグモジュール
3.5.16. キャッシュ・コヒーレンシー・ユニット
3.5.17. クロックソース
25.4.1. デバッグ・アクセス・ポート
25.4.2. CoreSight SoC-400タイムスタンプ・ジェネレーター
25.4.3. システム・トレース・マクロセル
25.4.4. トレースファネル
25.4.5. CoreSightのトレース・メモリー・コントローラー
25.4.6. AMBAトレース・バス・レプリケーター
25.4.7. トレース・ポート・インターフェイス・ユニット
25.4.8. NoCトレースポート
25.4.9. エンベデッド・クロス・トリガー・システム
25.4.10. エンベデッド・トレース・マクロセル
25.4.11. HPSのデバッグAPBインターフェイス
25.4.12. FPGAインターフェイス
25.4.13. デバッグクロック
25.4.14. デバッグのリセット
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20.5.3. I2Cコントローラーのディスエーブル
レジスターのIC_ENABLE_STATUSが追加され、IC_ENABLEレジスターが1から0に設定されたことに応答してハードウェアが完全にシャットダウンしたことをソフトウェアが明確に特定できるようになっています。†
- タイマーの間隔 (ti2c_poll) は、システムで使用されており、I2Cコントローラーによってサポートされる最大のI2C転送速度の信号周期の10倍に等しくなるように定義します。例えば、最大のI2C転送モードが400Kbpsの場合、ti2c_pollは25usになります。†
- 最大のタイムアウト・パラメーターであるMAX_T_POLL_COUNTを定義します。それにより、繰り返し行われるポーリングの動作がこの最大値を超えた場合にエラーが報告されます。†
- それ以降にソフトウェアが開始するI2Cマスター・トランザクションをブロックするスレッド/プロセス/機能を実行します。ただし、保留中の転送が完了することは許可します。
- I2CコントローラーがI2Cスレーブ専用の動作にプログラミングされている場合は、このステップを無視することができます。†
- 変数のPOLL_COUNTは0に初期化されます。†
- IC_ENABLEを0に設定します。†
- IC_ENABLE_STATUSレジスターを読み出し、IC_ENビット (ビット0) をテストします。POLL_COUNTを1増やします。POLL_COUNT >= MAX_T_POLL_COUNTの場合は、関連するエラーコードで終了します。†
- IC_ENABLE_STATUS[0] が1の場合は、ti2c_pollの間スリープし、1つ前のステップに戻ります。それ以外の場合は、関連する成功コードで終了します。†