インテルのみ表示可能 — GUID: hco1416492485138
Ixiasoft
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4.2.2. AFIのアドレスおよびコマンド信号
信号名 |
方向 |
幅 |
説明 |
---|---|---|---|
afi_addr |
入力 |
AFI_ADDR_WIDTH |
アドレス |
afi_bg |
入力 |
AFI_BANKGROUP_WIDTH |
バンクグループ (DDR4のみ) |
afi_ba |
入力 |
AFI_BANKADDR_WIDTH |
バンクアドレス |
afi_cke |
入力 |
AFI_CLK_EN_WIDTH |
クロックイネーブル |
afi_cs_n |
入力 |
AFI_CS_WIDTH |
チップセレクト信号。チップセレクトの数はランクの数と一致しない場合があります。例えばRDIMMおよびLRDIMMは、シングルランクおよびデュアルランクのコンフィグレーションに少なくとも2つのチップセレクト信号を必要とします。チップセレクト信号の幅に関しては、お使いのメモリーデバイスのデータシートを参照ください。 |
afi_ras_n |
入力 |
AFI_CONTROL_WIDTH |
RAS# (DDR3メモリーデバイス) |
afi_we_n |
入力 |
AFI_CONTROL_WIDTH |
WE# (DDR3メモリーデバイス) |
afi_rw_n |
入力 |
AFI_CONTROL_WIDTH * 2 |
RWA/B# (QDR-IV) |
afi_cas_n |
入力 |
AFI_CONTROL_WIDTH |
CAS# (DDR3メモリーデバイス) |
afi_act_n |
入力 |
AFI_CONTROL_WIDTH |
ACT# (DDR4) |
afi_rst_n |
入力 |
AFI_CONTROL_WIDTH |
RESET# (DDR3およびDDR4メモリーデバイス) |
afi_odt |
入力 |
AFI_CLK_EN_WIDTH |
DDR3メモリーデバイスのオンダイ終端信号。このメモリーデバイス信号を、FPGAの内部オンチップ終端信号と混同しないでください。 |
afi_par |
入力 |
AFI_CS_WIDTH |
アドレスおよびコマンドパリティー入力 (DDR4) アドレスパリティー入力 (QDR-IV) |
afi_ainv |
入力 |
AFI_CONTROL_WIDTH |
アドレス反転 (QDR-IV) |
afi_mem_clk_disable |
入力 |
AFI_CLK_PAIR_COUNT |
この信号がアサートされると、mem_clkおよびmem_clk_nは無効になります。この信号は低電力モードで使用されます。 |
afi_wps_n |
出力 |
AFI_CS_WIDTH |
WPS (QDR II/II+メモリーデバイス) |
afi_rps_n |
出力 |
AFI_CS_WIDTH |
RPS (QDR II/II+メモリーデバイス) |