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1. Arria® 10デバイスにおけるロジック・アレイ・ブロックおよびアダプティブ・ロジック・モジュール
2. Arria® 10デバイスにおけるエンベデッド・メモリー・ブロック
3. Arria® 10デバイスにおける可変精度 DSP ブロック
4. Arria® 10デバイスにおけるクロック・ネットワークおよび PLL
5. Arria® 10 デバイスにおける I/O と高速 I/O
6. Arria® 10 デバイスにおける外部メモリー・インターフェイス
7. Arria® 10デバイスにおけるコンフィグレーション、デザイン・セキュリティー、およびリモート・システム・アップグレード
8. Arria® 10デバイスにおける SEUの緩和
9. Arria® 10デバイスにおける JTAG バウンダリー・スキャン・テスト
10. Arria 10デバイスにおけるパワー・マネジメント
2.1. エンベデッド・メモリーの種類
2.2. Arria® 10デバイスにおけるエンベデッド・メモリー・デザイン・ガイドライン
2.3. エンベデッド・メモリーの機能
2.4. エンベデッド・メモリー・モード
2.5. エンベデッド・メモリーのクロッキング・モード
2.6. メモリーブロックでのパリティービット
2.7. エンベデッド・メモリー・ブロックでのバイトイネーブル
2.8. メモリーブロックのパックモード・サポート
2.9. メモリーブロックのアドレス・クロック・イネーブルのサポート
2.10. メモリーブロックの非同期クリアー
2.11. メモリーブロック誤り訂正コードのサポート
2.12. 改訂履歴
5.7.1. Arria® 10 デバイスにおける I/O および高速 I/O の一般的なガイドライン
5.7.2. 電圧リファレンス形式および非電圧リファレンス形式の I/O 規格の混在
5.7.3. ガイドライン : パワーシーケンス中に I/O ピンをドライブしない
5.7.4. ガイドライン : HPS 共有 I/O バンクでの I/O ピンの使用
5.7.5. ガイドライン : 最大 DC 電流制限
5.7.6. ガイドライン : アルテラ LVDS SERDES IP コアのインスタンス化
5.7.7. ガイドライン : ソフト CDR モードの LVDS SERDES ピンペア
5.7.8. ガイドライン : Arria 10 GPIO 性能でのジッターへの高影響の最小化
5.7.9. ガイドライン : 外部メモリー・インターフェイスのための I/O バンク 2A の使用
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5.2.3. Arria® 10 デバイスにおける I/O 規格の電圧レベル
I/O 規格 | VCCIO(V) | VCCPT(V) ( プリドライバー電圧 ) |
VREF(V) ( 入力 Ref 電圧 ) |
VTT(V) ( ボード終端電圧 ) |
|
---|---|---|---|---|---|
入力6 | 出力 | ||||
3.0 V LVTTL/3.0 V LVCMOS | 3.0/2.5 | 3.0 | 1.8 | — | — |
2.5 V LVCMOS | 3.0/2.5 | 2.5 | 1.8 | — | — |
1.8 V LVCMOS | 1.8 | 1.8 | 1.8 | — | — |
1.5 V LVCMOS | 1.5 | 1.5 | 1.8 | — | — |
1.2 V LVCMOS | 1.2 | 1.2 | 1.8 | — | — |
SSTL-18 Class I および Class II | VCCPT | 1.8 | 1.8 | 0.9 | 0.9 |
SSTL-15 Class I および Class II | VCCPT | 1.5 | 1.8 | 0.75 | 0.75 |
SSTL-15 | VCCPT | 1.5 | 1.8 | 0.75 | 0.75 |
SSTL-135 Class I および Class II | VCCPT | 1.35 | 1.8 | 0.675 | — |
SSTL-125 Class I および Class II | VCCPT | 1.25 | 1.8 | 0.625 | — |
SSTL-12 Class I および Class II | VCCPT | 1.2 | 1.8 | 0.6 | — |
POD12 | VCCPT | 1.2 | 1.8 | 0.84 | 1.2 |
1.8 V HSTL Class I および Class II | VCCPT | 1.8 | 1.8 | 0.9 | 0.9 |
1.5 V HSTL Class I および Class II | VCCPT | 1.5 | 1.8 | 0.75 | 0.75 |
1.2 V HSTL Class I および Class II | VCCPT | 1.2 | 1.8 | 0.6 | 0.6 |
HSUL-12 | VCCPT | 1.2 | 1.8 | 0.6 | — |
差動 SSTL-18 Class I および Class II | VCCPT | 1.8 | 1.8 | — | 0.9 |
差動 SSTL-15 Class I および Class II | VCCPT | 1.5 | 1.8 | — | 0.75 |
差動 SSTL-15 | VCCPT | 1.5 | 1.8 | — | 0.75 |
差動 SSTL-135 Class I および Class II | VCCPT | 1.35 | 1.8 | — | 0.675 |
差動 SSTL-125 Class I および Class II | VCCPT | 1.25 | 1.8 | — | 0.625 |
差動 SSTL-12 Class I および Class II | VCCPT | 1.2 | 1.8 | — | 0.6 |
差動 POD12 | VCCPT | 1.2 | 1.8 | — | 1.2 |
差動 1.8 V HSTL Class I および Class II | VCCPT | 1.8 | 1.8 | — | 0.9 |
差動 1.5 V HSTL Class I および Class II | VCCPT | 1.5 | 1.8 | — | 0.75 |
差動 1.2 V HSTL Class I および Class II | VCCPT | 1.2 | 1.8 | — | 0.6 |
差動 HSUL-12 | VCCPT | 1.2 | 1.8 | — | — |
LVDS | VCCPT | 1.8 | 1.8 | — | — |
Mini-LVDS | VCCPT | 1.8 | 1.8 | — | — |
RSDS | VCCPT | 1.8 | 1.8 | — | — |
LVPECL ( 差動クロック入力専用 ) | VCCPT | — | 1.8 | — | — |
6 SSTL、HSTL、差動 SSTL、差動 HSTL、POD、差動 POD、LVDS、RSDS、Mini-LVDS、LVPECL、HSUL、および差動 HSUL の入力は、VCCPTによって駆動します。