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Ixiasoft
5.1.7.1. PHYインターフェイスの選択に関するデザインの考慮事項
5.1.7.2. USBインターフェイスのデザイン・ガイドライン
5.1.7.3. SD/MMCおよびeMMCカード・インターフェイスのデザイン・ガイドライン
5.1.7.4. フラッシュ・インターフェイスのデザイン・ガイドライン
5.1.7.5. UARTインターフェイスのデザイン・ガイドライン
ガイドライン: HPS Firstブートおよびコンフィグレーション・スキームでは、HPS UARTペリフェラルをHPS専用I/Oバンクに割り当てます
ガイドライン: FPGA Firstブートおよびコンフィグレーション・スキームでは、HPS UARTをHPS専用I/OまたはFPGA I/Oに割り当てることができます
ガイドライン: FPGAファブリックを介してUART信号をルーティングする場合は、フロー・コントロール信号を適切に接続します
5.1.7.6. I2Cインターフェイスのデザイン・ガイドライン
9.1. 概要
9.2. ゴールデン・ハードウェア・リファレンス・デザイン (GHRD)
9.3. ソフトウェア要件の定義
9.4. ソフトウェア・アーキテクチャーの定義
9.5. ソフトウェア・ツールの選択
9.6. ブートローダー・ソフトウェアの選択
9.7. アプリケーションに対するオペレーティング・システムの選択
9.8. Linux*に向けたソフトウェア開発プラットフォームの構築
9.9. パートナーOSまたはRTOSに向けたソフトウェア開発プラットフォームの構築
9.10. ドライバーに関する考慮事項
9.11. ブートとコンフィグレーションに関する考慮事項
9.12. システムリセットに関する考慮事項
9.13. フラッシュに関する考慮事項
9.14. アプリケーションの開発
9.15. テストと検証
9.16. エンベデッド・ソフトウェアのデザイン・ガイドラインの改訂履歴
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Ixiasoft
5.1.7.5. UARTインターフェイスのデザイン・ガイドライン
HPSブート・ファームウェアは、ブートプロセス全体を通してコンソール・ステータス・メッセージをHPS UARTポートに出力します。ブート・ファームウェア・コンソール出力を確認する場合は、次のガイドラインを考慮し、HPS UARTペリフェラルをHPSブート時に使用可能なデバイスI/Oに割り当てます。
ガイドライン: HPS Firstブートおよびコンフィグレーション・スキームでは、HPS UARTペリフェラルをHPS専用I/Oバンクに割り当てます
SDMは、HPSを起動する前にHPS専用I/OおよびHPS EMIF I/Oをコンフィグレーショし、ユーザーモードにリリースします (Early I/O Releaseフロー)。そのほかのFPGA I/Oおよびファブリックは、ブートフローの後半で残りのFPGAがコンフィグレーションされるまで使用できません。
ガイドライン: FPGA Firstブートおよびコンフィグレーション・スキームでは、HPS UARTをHPS専用I/OまたはFPGA I/Oに割り当てることができます
SDMは、HPSを起動する前にI/Oリング全体を含むFPGA部分全体をコンフィグレーションします。
ガイドライン: FPGAファブリックを介してUART信号をルーティングする場合は、フロー・コントロール信号を適切に接続します
FPGAを介してUART信号をルーティングする場合、フロー・コントロール信号を利用することができます。フロー・コントロールを使用しない場合は、FPGAで信号を次の表に示すように接続します。
信号 | 方向 | 接続 |
---|---|---|
CTS | 入力 | Low |
DSR | 入力 | High |
DCD | 入力 | High |
RI | 入力 | High |
DTR | 出力 | 接続なし |
RTS | 出力 | 接続なし |
OUT1_N | 出力 | 接続なし |
OUT2_N | 出力 | 接続なし |
詳細は、 Agilex™ 7ハード・プロセッサー・システムのテクニカル・リファレンス・マニュアルで、「UARTコントローラー」のセクションを参照してください。