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5.1.1. 目的
5.1.2. ソフトウェア開発プラットフォームのコンポーネントの構築
5.1.3. アプリケーションに向けたオペレーティング・システムの選択
5.1.4. Linuxに向けたソフトウェア開発プラットフォームの構築
5.1.5. ベアメタル・アプリケーションに向けたソフトウェア開発プラットフォームの構築
5.1.6. パートナーOSまたはRTOSに向けたソフトウェア開発プラットフォームの構築
5.1.7. ブート・ローダー・ソフトウェアの選択
5.1.8. 開発、デバッグおよびトレースに向けたソフトウェア・ツールの選択
5.1.9. ボードの立ち上げに関する考慮事項
5.1.10. ブートおよびコンフィグレーションに関するデザインの考慮事項
5.1.11. フラッシュ・デバイス・ドライバーに関するデザインの考慮事項
5.1.12. HPS ECCに関するデザインの考慮事項
5.1.13. セキュリティーに関するデザインの考慮事項
5.1.14. エンベデッド・ソフトウェアのデバッグとトレース
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4.3.3.1. デバイスの電源投入
ガイドライン: AN 738: Intel Arria 10 Device Design Guidelinesの「Device Driver Power-Up」の章で示されているガイドラインに従います。
さらに、 インテル® Arria® 10 SoCデバイスに関する次のガイドラインを考慮します。
電源投入と電源切断のシーケンス
インテル® Arria® 10 SoCデバイスでは、電源シーケンスに関して、さらに次の電源レールを考慮する必要があります。
- VCCL_HPS
- VCCPLL_HPS、VCCIOREF_HPS
- VCCIO_HPS
詳細に関しては、インテル Arria 10コア・ファブリックおよび汎用I/Oハンドブックの「インテル Arria 10デバイスにおけるパワー・マネジメント」の章を参照してください。