インテルのみ表示可能 — GUID: mwh1409959645729
Ixiasoft
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3.1. インテル® Quartus® Prime開発ソフトウェアでのメタスタビリティー解析
非同期信号転送におけるメタスタビリティーによるエラーを最小限に抑えるために、回路設計者は通常、一連のレジスター (同期レジスターチェーンまたはシンクロナイザー) を宛先のクロックドメインで使用し、信号を新しいクロックドメインに再同期します。それにより、メタスタビリティー状態になる可能性のある信号が既知の値になるための追加時間を確保します。設計者は通常、2つのレジスターを使用して新しい信号を同期しますが、標準的な3つのレジスターを使用することで、より優れたメタスタビリティー保護が得られます。
タイミング・アナライザーでは、タイミング要件を満たす各シンクロナイザーを特定し、そのMTBFを解析および報告することができます。また、デザイン全体のMTBFの推定値を生成することができます。開発ソフトウェアはこの情報を使用してデザインのMTBFを最適化します。また、この情報を使用して、デザインにより長いシンクロナイザー・チェーンが必要かを判断することができます。