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1.4.1.1. 同期メモリーブロックの使用
1.4.1.2. サポートされないリセットおよびコントロール条件の回避
1.4.1.3. Read-During-Write動作の確認
1.4.1.4. RAMの推論と実装の制御
1.4.1.5. シングルクロック同期RAM (古いデータでのRead-During-Write動作)
1.4.1.6. シングルクロック同期RAM (新しいデータでのRead-During-Write動作)
1.4.1.7. シンプル・デュアルポート、デュアルクロック同期RAM
1.4.1.8. トゥルー・デュアルポート同期RAM
1.4.1.9. 混合幅デュアルポートRAM
1.4.1.10. バイト・イネーブル信号を備えるRAM
1.4.1.11. 電源投入時の初期のメモリーコンテンツの指定
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2.5.6. デザイン・アシスタント規則のカテゴリー
各デザイン・アシスタント規則には英数字の一意のIDがあり、規則のカテゴリーを反映しています。デザイン・アシスタントの規則は、コンパイルの特定のステージに対して有効または無効にすることができます。次の表は、デザイン・アシスタント規則のすべてのカテゴリーを一覧にし、規則に関するIntel® Quartus® Prime Pro Edition Helpの資料へのリンクを示しています。一部のカテゴリーはデバイスに固有です。
規則のカテゴリーとヘルプリンク | 頭字語 | 詳細 |
---|---|---|
Clock Domain Crossing Rules | CDC | クロック・ドメイン・クロッシングの規則チェック |
Clock Rules | CLK | クロックの規則チェック |
Floorplanning Rules | FLP | フロアプランニングの規則チェック (Logic Lock領域や輻輳など) |
Linting Rules | LNT | プログラム上のエラーとスタイル上のエラーに対するソースコードの規則チェック |
Project Rules | PRJ | インテル® Quartus® Primeプロジェクトに関連する規則チェック |
Reset Domain Crossing | RDC | リセット・ドメイン・クロッシングの規則チェック |
Reset Rules | RES | リセットの規則チェック |
Timing Closure Rules | TMC | タイミング・クロージャーの規則チェック |