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3.1.1. Avalon® -STコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.1.2. Avalon-STデバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングルデバイスのコンフィグレーション
3.1.6. Avalon® -STコンフィグレーション・スキームのデバッグガイドライン
デバッグの提案
3.1.7. Avalon® -STコンフィグレーション・スキームで使用するIP :インテル FPGAパラレル・フラッシュ・ローダーII IPコア
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. 最大許容外部AS_DATAピンスキュー遅延ガイドライン
3.2.6. シリアル・コンフィグレーション・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリー のレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. ASコンフィグレーション・スキームのデバッグガイドライン
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3.1.6. Avalon® -STコンフィグレーション・スキームのデバッグガイドライン
Avalon® -STコンフィグレーション・スキームは、以前は高速パッシブパラレル(FPP)モードで使用可能だったものに置き換わるものです。このコンフィグレーション・スキームは、同様の機能とパフォーマンスを保持します。重要な違いは次のとおりです。
- Avalon® -STコンフィグレーション・スキームでは、フロー制御信号AVST_READYを監視する必要があります。 AVST_READY 信号は、デバイスがコンフィグレーション・データを受信できるかどうかを示します。
- AVST_CLK と AVSTx8_CLK コンフィギュレーション・データが転送されていないときは、クロック信号を一時停止することはできません。 AVST_READY と AVST_VALIDがLowの場合データが転送されません。AVST_CLK と AVSTx8_CLKクロック信号は、CONF_DONEがアサートされるまで連続して実行する必要があります。
デバッグの提案
Avalon® -ST コンフィグレーション・スキームに関連するこれらのデバッグのヒントを検討する前に、デバッグガイドの章にある一般的なコンフィグレーション・デバッグ・チェックリストを確認してください。
- AVST_VALID SDMがアサートした後 AVST_READYをアサートします。
- AVST_DATAが有効の場合にのみAVST_VALIDをアサートします。
- コンフィギュレーションが完了するまで、AVST_CLKクロック信号が継続的でフリー ランニングであることを確認します。AVST_CLKは、CONF_DONEがアサートされた後に停止できます。 初期化状態では、AVST_CLK信号は必要ありません。
- x8モードを使用する場合、このインターフェイスのピン(クロック、データ、有効で準備完了)には必ず専用SDM_IOを使用してください。
- x16またはx32モードを使用している場合、 1.2 Vにはx16またはx32ピンを含むI/Oバンク(I/Oバンク3A)に電力を供給します。
- インテル® Quartus® Primeプロ・エディションプロジェクトで適切な Avalon® -STコンフィグレーション・スキームを選択してください。
- MSEL ピンはこのモードをPCBに反映することを確認してください。
- インテル® Agilex™ デバイスの電源が入る前にホストデバイスがコンフィグレーション・ピンを駆動しないことを確認してください 。
- nCONFIG コンフィグレーション・プロセス中はHighままで確認します。
- CONF_DONEピンとINIT_DONE ピンが インテル® Quartus® Prime SDM I/O ピンの割り当てとボード レベルの接続に関連付けられていることを確認します。
- 電源投入時に、nSTATUS信号をLowに駆動する外部コンポーネントがないことを確認してください。
関連情報