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3.1.1. Avalon® -STコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.1.2. Avalon-STデバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングルデバイスのコンフィグレーション
3.1.6. Avalon® -STコンフィグレーション・スキームのデバッグガイドライン
3.1.7. Avalon® -STコンフィグレーション・スキームで使用するIP :インテル FPGAパラレル・フラッシュ・ローダーII IPコア
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. 最大許容外部AS_DATAピンスキュー遅延ガイドライン
3.2.6. シリアル・コンフィグレーション・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリー のレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. ASコンフィグレーション・スキームのデバッグガイドライン
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1.2.1.2. インテル® Agilex™ SoCデバイスの起動順序の指定
インテル® Agilex™ SoCデバイスでは、FPGAFirstまたはHardProcessor System(HPS)Firstオプションのいずれかを選択して、コンフィグレーション順序を指定できます。
FPGA Firstオプションを選択すると、SDMはFPGAを完全にコンフィグレーションし、次にHPS SDRAMピンをコンフィグレーションし、HPSファースト・ステージ・ブート・ローダー(FSBL)をロードして、HPSのリセットを解除します。このモードでは、HPSがリセットを終了する直前にファブリックが機能を開始します。 FPGA Firstオプションでは、HPSを使用したFPGAのリコンフィグレーションは許可されないことに注意してください。このユーザーガイドは、FPGAが機能しているときの状態を定義します。設定と初期化が完了しました。
HPS Firstオプションを選択すると、SDMは最初にHPS SDRAMピンをコンフィグレーションし、HPS FSBLをロードして、HPSのリセットを解除します。次に、HPSはFPGA I/OおよびFPGAファブリックを後でコンフィグレーションします。 HPS Firstオプションには、次の利点があります。
- 必要なSDMフラッシュメモリー の量を最小限に抑えます。
- HPSソフトウェアが起動して実行されるまでにかかる時間を最小限に抑えます。
- HPSの実行中にFPGAのリコンフィグレーションをサポートします。