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3.1.1. Avalon® -STコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.1.2. Avalon-STデバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングルデバイスのコンフィグレーション
3.1.6. Avalon® -STコンフィグレーション・スキームのデバッグガイドライン
3.1.7. Avalon® -STコンフィグレーション・スキームで使用するIP :インテル FPGAパラレル・フラッシュ・ローダーII IPコア
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. 最大許容外部AS_DATAピンスキュー遅延ガイドライン
3.2.6. シリアル・コンフィグレーション・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリー のレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. ASコンフィグレーション・スキームのデバッグガイドライン
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3.2.8. AS_CLK
インテル® Agilex™ デバイスはAS_CLK をシリアル フラッシュ デバイスに駆動します。 内部発振器またはOSC_CLK_1 ピンを駆動する外部クロックは、AS_CLKを生成します。外部クロックソースを使用すると、AS_CLK をより高い周波数で動作させることができます。25 MHz、100 MHzz、または125 MHzクロックをOSC_CLK_1ピンに提供すると、AS_CLK は最大 133 MHzで動作できます。
AS_CLK のピン インテル® Quartus® Prime で説明されているソフトウェア アクティブなシリアル・コンフィグレーション・ソフトウェアの設定に必要な最大周波数を設定します。AS_CLK ピンは選択した周波数以下で動作します。
コンフィグレーション・クロック・ソース | クロック周波数 (MHz) |
---|---|
内蔵オシレーター | 25 58 77 115 |
OSC_CLK_1 25~125 MHz | 25 50 71.5 100 125 166 |
注: ファームウェアが無効な AS_CLK設定のビットストリームを受信すると、コンフィギュレーションは失敗します。 21.1 より前の インテル® Quartus® Primeソフトウェア・バージョンのファームウェアでは、AS_CLKが正しく設定されていない場合、ファームウェアはデフォルトでAS_CLK周波数を 50 MHz に設定して、AS x4 構成を完了します。