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3.1.1. Avalon® -STコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.1.2. Avalon-STデバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングルデバイスのコンフィグレーション
3.1.6. Avalon® -STコンフィグレーション・スキームのデバッグガイドライン
3.1.7. Avalon® -STコンフィグレーション・スキームで使用するIP :インテル FPGAパラレル・フラッシュ・ローダーII IPコア
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. 最大許容外部AS_DATAピンスキュー遅延ガイドライン
3.2.6. シリアル・コンフィグレーション・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリー のレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. ASコンフィグレーション・スキームのデバッグガイドライン
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3.1.7.3.2. PFL II IPコアとフラッシュアドレスのマッピング
PFL IPコアとフラッシュ・メモリー・デバイス間のアドレス接続は、フラッシュ・メモリー・デバイスのベンダーとデータバス幅によって異なります。
図 28. 8ビットモードのフラッシュメモリーPFL IPコアとフラッシュ・メモリー・デバイス間のアドレス接続は同じです。
図 29. 16ビットモードのフラッシュメモリー16ビット・フラッシュ・メモリーのフラッシュ・メモリー・アドレスは、II IPコアのフラッシュアドレスと比較して1ビット下にシフトします。フラッシュメモリーのフラッシュアドレスは、ビット0ではなくビット1から始まります。
図 30. 8ビットモードのCypressおよびMicron M28、M29フラッシュメモリーCypressの8ビットフラッシュのフラッシュ・メモリー・アドレスは、1ビット上にシフトします。PFL Ipコアのアドレスビット0は、フラッシュメモリーのデータピン D15 に接続します。
図 31. 16ビットモードのSpansionおよびMicron M28、M29フラッシュメモリーPFL IPコアとフラッシュ・メモリー・デバイス間のアドレスビット番号は同じです。