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7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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1.4. デバイスファミリーのサポート
次の用語は、インテルFPGA IP コアのデバイスサポートのレベルを定義しています。
- Advance support - IPコアは、このデバイスファミリーのシミュレーションおよびコンパイルに使用可能です。タイミングモデルには、レイアウト後の情報に基づいた遅延についての初期の技術的評価が含まれています。このタイミングモデルは、シリコンのテストが実際のシリコンとタイミングモデルの相関を改善するため、変更される可能性があります。このIPコアは、システム・アーキテクチャーおよびリソース使用率の調査、シミュレーション、ピンアウト、システム・レイテンシーの評価、基本的なタイミング評価 (パイプライン・バジェット)、I/O転送ストラテジー (データパス幅、バースト深度、I/O規格のトレードオフ) に使用できます。
- Preliminary support - IPコアは、このデバイスファミリー用の暫定タイミングモデルで検証されます。IPコアはデバイスファミリーの機能要件をすべて満たしていますが、タイミング解析は実施中である場合があります。よって、量産デザインでの使用には注意が必要です。
- Final support - IPコアは、このデバイスファミリー用の最終タイミングモデルで検証されます。IPコアはデバイスファミリーの機能要件およびタイミング要件をすべて満たしており、量産デザインで使用可能です。
デバイスファミリー |
サポートのレベル |
---|---|
インテルStratix 10 |
最終サポート |
その他のデバイスファミリー |
サポートなし その他のデバイスファミリーのサポート情報については、インテルWebサイト上の Intel PCI Express SolutionsのWebページを参照してください。 |