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7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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7.2.1.2. Avalon-MM to PCI Express割り込みイネーブルレジスター
割り込みイネーブルレジスターは、MSIまたはレガシー割り込みのいずれかをイネーブルします。
PCI Express割り込みは、Avalon-MM to PCI Express Interrupt Enable レジスターの対応するビットを設定することにより、Avalon-MM to PCI Express Interrupt Status レジスターに登録された任意の条件に対してアサートできます。
ビット |
名称 |
アクセス |
説明 |
---|---|---|---|
[31:16] |
予約済み |
該当なし |
該当なし |
[15:0] |
AVL_IRQ[15:0] | RW |
指定されたAvalon-MM割り込み信号がアサートされた場合、PCI Express割り込みの生成を可能にします。システムには、最大16個の独立した入力割り込み信号を持つことができます。 |