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7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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11.1.4. サードパーティー製PCIeアナライザーの使用
PCI Express用サードパーティー製プロトコル・アナライザーは、物理リンク上のトラフィックを記録し、トラフィックをデコードするため、ユーザーがシンボルを変換する手間を省けます。サードパーティー製プロトコル・アナライザーは、さまざまな要件に応じて異なるレベルで双方向トラフィックを表示することができます。高位レベルの診断に対しては、アナライザーは、リンクの両側にあるデバイスのLTSSMフローを並べて表示します。この表示は、リンク・トレーニング・ハンドシェイク動作を確認し、トラフィックが滞っている場所を特定する場合に役立ちます。トラフィック・アナライザーは、パケットの内容を表示できるため、ユーザーはその内容を確認することができます。詳細については、サードパーティー各社の資料を参照してください。