インテルのみ表示可能 — GUID: hpk1504217461500
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7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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11.2.1.3.4. ltssm_debug_check
ltssm_debug_check コマンド、現在の PCIe* リンクステータスを返します。リンクの状態についての一般的な情報を提供します。このコマンドはリアルタイム・データを返すため、不安定なリンクは実行するたびに異なるステートを返します。
% ltssm_debug_check
出力例:
############################################################# ##### LTSSM Quick Debugs Check Status ##### ############################################################# This PCIe is GEN1X8 Pin_Perstn signal is High SerDes PLL is Locked Link is Up NOT all Channel CDRs are Locked to Data LTSSM FIFO is Full LTSSM FIFO is NOT Empty LTSSM FIFO stored 1024 data Current LTSSM State is 010001 L0