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7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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3.3.2. Avalon-MM Slaveインターフェイス
Avalon-MM Slave Interface: Avalon-MM Slaveモジュールは、Avalon-MMインターフェイス上の読み出しおよび書き込みトランザクションをPCI Express MRdおよびMWr TLP要求に変換します。これらのモジュールは、Avalon-MMインターフェイスの読み出しデータバス上のPCI Express Completion TLPで受信したデータを返します。
Avalon-MM Slaveモジュールには、使用可能な2つのバージョンがあります。バーストAvalon-MM Slaveは高スループット転送用であり、アプリケーション・インターフェイスのデータバス幅は256ビットまたは64ビットのいずれかです。非バーストAvalon-MM Slaveは、バイトイネーブル制御に細かい粒度を必要とする小さな転送用です。非バーストAvalon-MM Slaveインターフェイスのプリフィクスは txs* です。バーストAvalon-MM Slaveインターフェイスのプリフィクスは hptxs_* です。
Avalon-MM Slaveのタイプ | データバス幅 | 最大バーストサイズ | バイトイネーブルの粒度 | 最大の未処理の読み出し要求 |
---|---|---|---|---|
非バースト | 32ビット | 1サイクル | Byte | 1 |
バースト | 256ビット | 16サイクル | DWord | 32 |
バースト | 64ビット | 64サイクル | Byte | 16 |
バーストAvalon-MM Slaveは、列挙後にシステム・ソフトウェアによって設定される最大ペイロードサイズおよび読み出し要求の最大サイズの値に従います。必要に応じて、1つのAvalon-MMバースト・トランザクションに対して複数のPCIe TLPを生成します。
バーストカウント | 最大ペイロードサイズまたは読み出し要求の最大サイズ | ||
---|---|---|---|
128バイト | 256バイト | 512バイト | |
1から4 | 1個のTLP | 1個のTLP | 1個のTLP |
5から8 | 2個のTLP | 1個のTLP | 1個のTLP |
9から12 | 3個のTLP | 2個のTLP | 1個のTLP |
13から16 | 4個のTLP | 2個のTLP | 1個のTLP |
注: 上の表のバーストサイズは、256ビットのアプリケーション・インターフェイス幅に対するものです。