インテルのみ表示可能 — GUID: lbl1466445324499
Ixiasoft
7.1.1. レジスターアクセスの定義
7.1.2. PCIコンフィグレーション・ヘッダー・レジスター
7.1.3. PCI Express機能構造
7.1.4. インテル定義のVSEC Capabilityヘッダー
7.1.5. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター
7.1.6. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
7.1.8. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
10.5.1. ebfm_barwrプロシージャー
10.5.2. ebfm_barwr_immプロシージャー
10.5.3. ebfm_barrd_waitプロシージャー
10.5.4. ebfm_barrd_nowtプロシージャー
10.5.5. ebfm_cfgwr_imm_waitプロシージャー
10.5.6. ebfm_cfgwr_imm_nowtプロシージャー
10.5.7. ebfm_cfgrd_waitプロシージャー
10.5.8. ebfm_cfgrd_nowtプロシージャー
10.5.9. BFMコンフィグレーション・プロシージャー
10.5.10. BFM共有メモリー・アクセス・プロシージャー
10.5.11. BFMログおよびメッセージ・プロシージャー
10.5.12. Verilog HDL Formattingファンクション
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Ixiasoft
7.1.7. Correctable Internal Error Status (修正可能な内部エラーステータス) レジスター
ビット |
レジスターの説明 |
リセット値 |
アクセス |
---|---|---|---|
[31:12] |
予約済み |
0 |
RO |
[11] | Config RAMの修正可能なECCエラーステータス | 0 | RW1CS |
[10] | Retry Bufferの修正可能なECCエラーステータス | 0 | RW1CS |
[9] | TLP RAMのRetry Startの修正可能なECCエラーステータス | 0 | RW1CS |
[8] | 予約済み | 0 | RO |
[7] | 予約済み | 0 | RO |
[6] | FPGAによってレポートされた内部エラー | 0 | RW1CS |
[5] |
予約済み |
0 |
RO |
[4] |
PHY Gen3 SKPエラーが発生しました。Gen3データパターンにSKPパターン (8'b10101010) が含まれていると、SKP OSとして誤って解釈され、PHYで誤ったブロック・リアライメントが発生します。 |
0 |
RW1CS |
[3] | RX Buffer Header RAM #2の修正可能なECCエラーステータス | 0 | RW1CS |
[2] | RX Buffer Header RAM #1の修正可能なECCエラーステータス | 0 | RW1CS |
[1] |
RX Buffer Data RAM #2の修正可能なECCエラーステータス |
0 |
RW1CS |
[0] |
RX Buffer Data RAM #1の修正可能なECCエラーステータス |
0 |
RW1CS |