インテルのみ表示可能 — GUID: vgo1440400657307
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2.1. インテル® Stratix 10® エンベデッド・メモリー・ブロックにおけるバイトイネーブル
2.2. アドレス・クロック・イネーブルのサポート
2.3. 非同期クリアと同期クリア
2.4. メモリーブロックの誤り訂正コードのサポート
2.5. Force-to-Zero
2.6. コヒーレント読み出しメモリー
2.7. フリーズロジック
2.8. トゥルー・デュアル・ポート・デュアル・クロック・エミュレーター
2.9. インテル® Stratix 10® でサポートされているエンベデッド・メモリーIPコア
2.10. インテル® Stratix 10® エンベデッド・メモリーのクロッキング・モード
2.11. インテル® Stratix 10® エンベデッド・メモリーのコンフィグレーション
2.12. 読み出しアドレスレジスターおよび書き込みアドレスレジスターの初期値
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3.3.1. 同一ポートのRead-During-Writeモード
同一ポートのRead-During-Writeモードが適用されるのは、シングルポートRAM、シンプル・クワッドポートRAMまたはトゥルー・デュアルポートRAMの同一ポートです。
出力モード | メモリータイプ | 詳細 |
---|---|---|
New Data | M20K | 新しいデータは、新しいデータが書き込まれるのと同じクロックサイクルの立ち上がりエッジで使用可能です。 |
Don't Care | M20K、MLAB | RAMでは、Read-During-Write動作に対してDon't Care値を生成します。
注: QUAD_PORT動作モードの場合、 Don't Careモードは、同一ポートRead-During-Write動作に対する唯一の出力モードです。
|
図 20. 同一ポートRead-During-Write : New Dataモード次の図で示す機能波形例は、New Dataモードの同一ポートRead-During-Write動作のものです。
図 21. 同一ポートRead-During-Write : Don't Careモード次の図で示す機能波形例は、Don't Careモードの同一ポートRead-During-Write動作のものです。