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2.1. インテル® Stratix 10® エンベデッド・メモリー・ブロックにおけるバイトイネーブル
2.2. アドレス・クロック・イネーブルのサポート
2.3. 非同期クリアと同期クリア
2.4. メモリーブロックの誤り訂正コードのサポート
2.5. Force-to-Zero
2.6. コヒーレント読み出しメモリー
2.7. フリーズロジック
2.8. トゥルー・デュアル・ポート・デュアル・クロック・エミュレーター
2.9. インテル® Stratix 10® でサポートされているエンベデッド・メモリーIPコア
2.10. インテル® Stratix 10® エンベデッド・メモリーのクロッキング・モード
2.11. インテル® Stratix 10® エンベデッド・メモリーのコンフィグレーション
2.12. 読み出しアドレスレジスターおよび書き込みアドレスレジスターの初期値
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3.4. パワーアップ状態およびメモリー初期化の考慮事項
デザインロジックで初期パワーアップ値を評価する場合、異なるタイプのメモリーブロックのパワーアップ状態を考慮します。
メモリータイプ | 出力レジスター | パワーアップ値 |
---|---|---|
MLAB | 使用 | ゼロ (クリア) |
バイパス | メモリーコンテンツを読み出す | |
M20K | 使用 | ゼロ (クリア) |
バイパス | ゼロ (クリア) |
インテル® Quartus® Prime開発ソフトウェアではデフォルトで、 インテル® Stratix 10® デバイスのエンベデッド・メモリー・ブロックを初期化してゼロにします。これは、 .mif でメモリーコンテンツを指定しない限り適用します。
MLABおよびM20Kエンベデッド・メモリー・ブロックでは、 .mif による初期化をサポートしています。 .mif ファイルの インテル® Quartus® Prime開発ソフトウェアでの生成と、オンチップメモリーIPコアでの使用の指定は、デザインでメモリーのインスタンス化をする際に行います。メモリーを事前に初期化する (例えば .mif を使用する) 場合でも、そのメモリーのパワーアップは、出力がクリアされた状態で行います。