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5.1. コンフィグレーション・スペース・レジスターとPCIe仕様の対応関係
5.2. Type 0コンフィグレーション・スペース・レジスター
5.3. Type 1コンフィグレーション・スペース・レジスター
5.4. PCI Express機能構造
5.5. Intel定義のVSECレジスター
5.6. CvPレジスター
5.7. 64ビットおよび128ビットのAvalon-MMブリッジ・レジスターの説明
5.8. Avalon-MMルートポートのプログラミング・モデル
5.9. Uncorrectable Internal Error Mask(訂正不能な内部エラーマスク)レジスター
5.10. Uncorrectable Internal Error Status(訂正不能な内部エラー・ステータス)レジスター
5.11. Correctable Internal Error Mask(訂正可能な内部エラーマスク)レジスター
5.12. Correctable Internal Error Status(訂正可能な内部エラー・ステータス)レジスター
5.7.1.1. Avalon-MM to PCI Express割り込みステータス・レジスター
5.7.1.2. Avalon-MM to PCI Express割り込みイネーブル・レジスター
5.7.1.3. PCI Express Mailbox Registers
5.7.1.4. Avalon-MM-to-PCI Expressアドレス変換テーブル
5.7.1.5. エンドポイント用のPCI Express to Avalon-MM Interrupt StatusレジスターおよびEnableレジスター
5.7.1.6. Avalon-MM Mailbox Registers
5.7.1.7. Control Register Access (CRA) Avalon-MMスレーブポート
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1.9. 推奨スピードグレード
リンクレート |
リンク幅 |
インターフェイス幅 |
アプリケーション・クロック周波数(MHz) |
推奨スピードグレード |
---|---|---|---|---|
Gen1 |
×1 |
64ビット |
62.5 2、125 |
–4、–5、–6 |
×2 |
64ビット |
125 |
–4、–5、–6 |
|
×4 |
64ビット |
125 |
–4、–5、–6 |
|
×8 |
128ビット |
125 |
–4、–5、–6 |
|
Gen2 |
×1 |
64ビット |
125 | –4、–5 |
×2 |
64ビット |
125 |
–4、–5 |
|
×4 |
128ビット |
125 |
–4、–5 |
2 この数値は省電力モードです。