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5.1. コンフィグレーション・スペース・レジスターとPCIe仕様の対応関係
5.2. Type 0コンフィグレーション・スペース・レジスター
5.3. Type 1コンフィグレーション・スペース・レジスター
5.4. PCI Express機能構造
5.5. Intel定義のVSECレジスター
5.6. CvPレジスター
5.7. 64ビットおよび128ビットのAvalon-MMブリッジ・レジスターの説明
5.8. Avalon-MMルートポートのプログラミング・モデル
5.9. Uncorrectable Internal Error Mask(訂正不能な内部エラーマスク)レジスター
5.10. Uncorrectable Internal Error Status(訂正不能な内部エラー・ステータス)レジスター
5.11. Correctable Internal Error Mask(訂正可能な内部エラーマスク)レジスター
5.12. Correctable Internal Error Status(訂正可能な内部エラー・ステータス)レジスター
5.7.1.1. Avalon-MM to PCI Express割り込みステータス・レジスター
5.7.1.2. Avalon-MM to PCI Express割り込みイネーブル・レジスター
5.7.1.3. PCI Express Mailbox Registers
5.7.1.4. Avalon-MM-to-PCI Expressアドレス変換テーブル
5.7.1.5. エンドポイント用のPCI Express to Avalon-MM Interrupt StatusレジスターおよびEnableレジスター
5.7.1.6. Avalon-MM Mailbox Registers
5.7.1.7. Control Register Access (CRA) Avalon-MMスレーブポート
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1.4. デバイスファミリーのサポート
次の用語は、インテルFPGA IP コアのデバイスサポートのレベルを定義しています。
- Advance support - IPコアは、このデバイスファミリーのシミュレーションおよびコンパイルに使用可能です。タイミングモデルには、レイアウト後の情報に基づいた遅延についての初期の技術的評価が含まれています。このタイミングモデルは、シリコンのテストが実際のシリコンとタイミングモデルの相関を改善するため、変更される可能性があります。このIPコアは、システム・アーキテクチャーおよびリソース使用率の調査、シミュレーション、ピンアウト、システム・レイテンシーの評価、基本的なタイミング評価 (パイプライン・バジェット)、I/O転送ストラテジー (データパス幅、バースト深度、I/O規格のトレードオフ) に使用できます。
- Preliminary support - IPコアは、このデバイスファミリー用の暫定タイミングモデルで検証されます。IPコアはデバイスファミリーの機能要件をすべて満たしていますが、タイミング解析は実施中である場合があります。よって、量産デザインでの使用には注意が必要です。
- Final support - IPコアは、このデバイスファミリー用の最終タイミングモデルで検証されます。IPコアはデバイスファミリーの機能要件およびタイミング要件をすべて満たしており、量産デザインで使用可能です。
Device Family |
Support Level |
---|---|
Arria V |
Final. |
Other device families |
Refer to the Intel's PCI Express IP Solutions web page for other device families: |