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5.1. コンフィグレーション・スペース・レジスターとPCIe仕様の対応関係
5.2. Type 0コンフィグレーション・スペース・レジスター
5.3. Type 1コンフィグレーション・スペース・レジスター
5.4. PCI Express機能構造
5.5. Intel定義のVSECレジスター
5.6. CvPレジスター
5.7. 64ビットおよび128ビットのAvalon-MMブリッジ・レジスターの説明
5.8. Avalon-MMルートポートのプログラミング・モデル
5.9. Uncorrectable Internal Error Mask(訂正不能な内部エラーマスク)レジスター
5.10. Uncorrectable Internal Error Status(訂正不能な内部エラー・ステータス)レジスター
5.11. Correctable Internal Error Mask(訂正可能な内部エラーマスク)レジスター
5.12. Correctable Internal Error Status(訂正可能な内部エラー・ステータス)レジスター
5.7.1.1. Avalon-MM to PCI Express割り込みステータス・レジスター
5.7.1.2. Avalon-MM to PCI Express割り込みイネーブル・レジスター
5.7.1.3. PCI Express Mailbox Registers
5.7.1.4. Avalon-MM-to-PCI Expressアドレス変換テーブル
5.7.1.5. エンドポイント用のPCI Express to Avalon-MM Interrupt StatusレジスターおよびEnableレジスター
5.7.1.6. Avalon-MM Mailbox Registers
5.7.1.7. Control Register Access (CRA) Avalon-MMスレーブポート
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7. エラー処理
PCI Expressに準拠した各デバイスは、基本レベルのエラー管理を実装する必要があります。また、オプションで高度なエラー管理を実装することも可能です。 IPコアは、基本的なエラー報告と高度なエラー報告の両方を実装します。ルートポートのエラー処理は、エンドポイントのエラー処理よりも複雑です。
種類 |
要因となるエージェント |
説明 |
---|---|---|
訂正可能 |
ハードウェア |
訂正可能なエラーはシステムのパフォーマンスに影響する可能性がありますが、データの整合性は維持されます。 |
訂正不可、致命的でない |
デバイス・ソフトウェア |
訂正不可能で致命的でないエラーは、データが失われてもシステムの整合性が維持されるエラーと定義されます。たとえば、ファブリックは特定のTLPを失うことがありますが、問題なく動作します。 |
訂正不可、致命的 |
システム・ソフトウェア |
データの損失とシステムの障害によって生成されるエラーは、修正不可能で致命的であるとみなされます。ソフトウェアは、リンクをリセットする、あるいは問題を最小限に抑えるために他の手段を実装するといった、エラーの処理方法を決定する必要があります。 |