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1. インテル® Stratix 10® のクロッキングおよびPLLの概要
2. インテル® Stratix 10® のクロッキングおよびPLLのアーキテクチャーと機能
3. インテル® Stratix 10® のクロッキングおよびPLLデザイン検討事項
4. インテル® Stratix 10® のクロッキングおよびPLL実装ガイド
5. Stratix® 10 クロック制御 IP コアのリファレンス
6. Intel® FPGA IOPLL IP コアの参考資料
7. Intel® FPGA IOPLL Reconfig IP コアのリファレンス
A. インテル® Stratix 10® のクロッキングおよびPLLユーザーガイド改訂履歴
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4.3.1.3. Intel® FPGA IOPLL Reconfig IPコアのリコンフィグレーション・モード
Intel® FPGA IOPLL Reconfig IPコアには4つの機能リコンフィグレーション・モードがあります。リコンフィグレーション動作モードは、 mgmt_address [9:8]ビットの設定に基づいています。
リコンフィグレーション・モード | mgmt_address[9:8] 4 |
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.mifストリーミング・リコンフィグレーション | 2 00 |
クロック・ゲーティング・リコンフィグレーション | 2 10 |
ダイナミック位相シフト | 2 11 |
Mカウンター、 Nカウンター、帯域幅設定、またはチャージポンプ電流を変更するI/O PLLでダイナミック・リコンフィグレーションを実行した後、I/O PLLをリキャリブレーションする必要があります。 .mifストリーミング・リコンフィグレーションの場合、リキャリブレーションは自動的に行われます。クロック・ゲーティングとダイナミック位相シフトのリコンフィグレーションでは、リキャリブレーションは不要です。
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