インテルのみ表示可能 — GUID: mcn1440577973464
Ixiasoft
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2.1.2. クロック・リソース
デバイス | 使用可能なリソース数 | クロック・リソースのソース |
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トランシーバー : 24 の差動 I/O:32のシングルエンドまたは16の差動 |
トランシーバー・ピン : REFCLK_GXB[L,R][1,4][C,D,E,F,G,H,I,J,K,L,M,N]_CH[B,T][p,n] I/O PLLーCLK_[2,3][A..L]_[0,1][p,n] |
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トランシーバー : 48 の差動 I/O:32のシングルエンドまたは16の差動 |
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トランシーバー : 32 の差動 I/O:60のシングルエンドまたは30の差動 |
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MX 1100 | トランシーバー : 16 の差動 I/O:36のシングルエンドまたは18の差動 |
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トランシーバー : 32 の差動 I/O:56のシングルエンドまたは32の差動 |
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トランシーバー : 32 の差動 I/O:52のシングルエンドまたは26の差動 |
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トランシーバー : 32 の差動 I/O:64のシングルエンドまたは32の差動 |
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トランシーバー : 32 の差動 I/O:96のシングルエンドまたは48の差動 |
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トランシーバー : 53 の差動 I/O:36のシングルエンドまたは18の差動 |
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トランシーバー : 24 の差動 I/O:96のシングルエンドまたは48の差動 |
デバイス | 使用可能なリソース数 | クロック・リソースのソース |
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すべての インテル® Stratix 10® デバイス | 各クロックセクターの境界で32つの双方向プログラマブル・クロック・ルーティング | トランシーバー・バンク:
I/Oバンク :
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クロック入力ピンの接続についての詳細は、 ピン接続ガイドラインを参照してください。