インテルのみ表示可能 — GUID: coa1613084482044
Ixiasoft
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4.3.1.2.5. TXフロー・コントロール・インターフェイス
TLPを送信する前に、フロー・コントロール・ロジックは、リンクパートナーのRXポートにそれを受け入れるのに十分なバッファースペースがあることを確認します。TXフロー・コントロール・インターフェイスから、リンクパートナーの使用可能なRXバッファースペースをアプリケーションに報告します。ポステッド、ノンポステッド、およびコンプリーションTLPの使用可能なスペースをフロー・コントロール・クレジットという単位で報告します。RXフロー・コントロール・インターフェイスのセクションの定義を参照してください。
このIPでの一般的なクレジット・コントロールの実装方法についての詳細は、クレジット・コントロール を参照してください。
信号名 | 方向 | 説明 | EP/RP/BP | クロックドメイン |
---|---|---|---|---|
pX_tx_st_hcrdt_update_o[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | さまざまなタイプのヘッダーでクレジットが使用可能であることを示します。 各ヘッダー (TLPプリフィクスがある場合はそれを含む) で消費するクレジットは1つです。 [0]: ポステッド・ヘッダー (PH) [1]: ノンポステッド・ヘッダー (NPH) [2]: コンプリーション・ヘッダー (CPLH) リンクパートナーによって無制限のクレジットがアドバタイズされると、この信号は1クロックサイクルの間アサートされます。pX_tx_st_hcrdt_update_cnt_o の値は、クレジットの初期化フェーズの間は0です。 |
EP/RP/BP | coreclkout_hip |
pX_tx_st_hcrdt_update_cnt_o[5:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | リリースされたクレジットの数を示します。 [1:0]: リリースされたPHクレジットの数 [3:2]: リリースされたNPHクレジットの数 [5:4]: リリースされたCPLHクレジットの数 対応する pX_rx_st_hcrdt_update_i ビット = 1の場合に有効です。 リリースされるクレジットの最大数は3です。 リンクパートナーによって無制限のクレジットがアドバタイズされると、この信号は、クレジット初期化フェーズ中 (pX_tx_st_hcrdt_update_o が1クロックサイクルの間アサートされる間) は0を反映します。 |
EP/RP/BP | coreclkout_hip |
pX_tx_st_hcrdt_init_o[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | クレジット初期化インジケーターです。これらの信号は、初期化フェーズの間はHighのままです。HighからLowへの遷移は、クレジット初期化フェーズの完了を示します。 [0]: PH [1]: NPH [2]: CPLH |
EP/RP/BP | coreclkout_hip |
pX_tx_st_hcrdt_init_ack_i[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
入力 | アプリケーション・ロジックが、クレジット初期化フェーズの準備ができていることを示します。 [0]: PH [1]: NPH [2]: CPLH |
EP/RP/BP | coreclkout_hip |
pX_tx_st_dcrdt_update_o[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | 異なるタイプのデータでクレジットが使用可能であることを示します。 [0]: ポステッド・データ (PD) [1]: ノンポステッド・データ (NPD) [2]: コンプリーション・データ (CPLD) リンクパートナーによって無制限のクレジットがアドバタイズされると、この信号は1クロックサイクルの間アサートされます。pX_tx_st_hcrdt_update_cnt_o の値は、クレジットの初期化フェーズの間は0です。 |
EP/RP/BP | coreclkout_hip |
pX_tx_st_dcrdt_update_cnt_o[11:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | リリースされたクレジットの数を示します。 [3:0]: リリースされたPDクレジットの数 [7:4]: リリースされたNPDクレジットの数 [11:8]: リリースされたCPLDクレジットの数 対応する pX_tx_st_dcrdt_update_o ビット = 1の場合に有効です。 リリースされるクレジットの最大数は15です。 リンクパートナーによって無制限のクレジットがアドバタイズされると、この信号は、クレジット初期化フェーズ (pX_tx_st_dcrdt_update_o が1クロックサイクルの間アサートされる) 間は0を反映します。 |
EP/RP/BP | coreclkout_hip |
pX_tx_st_dcrdt_init_o[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
出力 | クレジット初期化インジケーターです。これらの信号は、初期化フェーズの間はHighのままです。HighからLowへの遷移は、クレジット初期化フェーズの完了を示します。 [0]: PD [1]: NPD [2]: CPLD |
EP/RP/BP | coreclkout_hip |
pX_tx_st_dcrdt_init_ack_i[2:0] (ここでは X = 0、1、2、3 (IPコア番号)) |
入力 | アプリケーション・ロジックが、クレジット初期化フェーズの準備ができていることを示します [0]: PD [1]: NPD [2]: CPLD |
EP/RP/BP | coreclkout_hip |