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1. Nios® Vエンベデッド・プロセッサーについて
2. インテル® Quartus® Prime開発ソフトウェアおよびプラットフォーム・デザイナーを使用した Nios® Vプロセッサーのハードウェア・システム・デザイン
3. Nios® Vプロセッサー・ソフトウェアのシステムデザイン
4. Nios® Vプロセッサーのコンフィグレーションと起動ソリューション
5. Nios® Vプロセッサー - MicroC/TCP-IPスタックの使用
6. Nios® Vプロセッサーのデバッグ、検証、およびシミュレーション
7. Nios® Vプロセッサー - リモート・システム・アップデート
8. Nios® Vエンベデッド・プロセッサー・デザイン・ハンドブックのアーカイブ
9. Nios® Vエンベデッド・プロセッサー・デザイン・ハンドブックの改訂履歴
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2.4.1.1. 一般的な使用例
- 電源投入時に reset_req 信号をアサートして、システム内の他のFPGAホストが Nios® Vプロセッサーのブートメモリーを初期化するまで、 Nios® Vプロセッサー・コアがリセットベクトルからプログラムの実行を開始しないようにすることができます。この場合、サブシステム全体でクリーンなハードウェア・リセットが発生する可能性があります。 Nios® Vプロセッサーは、他のFPGAホストがプロセッサーのブートメモリーを初期化するまで、無期限にリセット要求状態に保持されます。
- システムの残りの部分を中断せずに Nios® Vプロセッサー・コアをリセットする必要があるシステムでは、reset_req 信号をアサートして、コアの現在の動作を完全に停止できます。システムが reset_req_ack 信号をリリースしたら、リセットベクトルからプロセッサーを再起動します。
- 外部ホストは、リセット要求インターフェイスを使用することで、次のタスクの実装がより簡単になります。
- 現在の Nios® Vプロセッサー・プログラムを停止する
- 新しいプログラムを Nios® Vプロセッサーのブートメモリーにロードする
- プロセッサが新しいプログラムの実行を開始できるようにする
- リカバリー・タイムアウト周期を定義し、システムレベルのリセットでシステムリカバリーを実行します。
- ハードウェア・レベルのリセットを実行します。