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1. Nios® Vエンベデッド・プロセッサーについて
2. インテル® Quartus® Prime開発ソフトウェアおよびプラットフォーム・デザイナーを使用した Nios® Vプロセッサーのハードウェア・システム・デザイン
3. Nios® Vプロセッサー・ソフトウェアのシステムデザイン
4. Nios® Vプロセッサーのコンフィグレーションと起動ソリューション
5. Nios® Vプロセッサー - MicroC/TCP-IPスタックの使用
6. Nios® Vプロセッサーのデバッグ、検証、およびシミュレーション
7. Nios® Vプロセッサー - リモート・システム・アップデート
8. Nios® Vエンベデッド・プロセッサー・デザイン・ハンドブックのアーカイブ
9. Nios® Vエンベデッド・プロセッサー・デザイン・ハンドブックの改訂履歴
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4.5. コンフィグレーションQSPI フラッシュからの Nios® Vプロセッサーの起動
Nios® Vプロセッサーは、Active Serialコンフィグレーション・モードでコンフィグレーションQSPIフラッシュを使用して、次の2つのブートオプションをサポートします。
- Nios® Vプロセッサー・アプリケーションは、コンフィグレーションQSPIフラッシュからインプレースで実行されます。
- Nios® Vプロセッサー・アプリケーションは、ブートコピアーを使用してコンフィグレーションQSPIフラッシュからRAMにコピーされます。
関連するインテルFPGAデバイスに基づいて、以下の項を参照してください。
サポートされているブートメモリー | Nios Vの起動方法 | アプリケーションのランタイムの位置 | ブートコピアー |
---|---|---|---|
コントロール・ブロックベースのデバイス 3 (Generic Serial Flash Interface Intel® FPGA IPを使用) | コンフィグレーションQSPIフラッシュからインプレースで実行するNios Vプロセッサー・アプリケーション |
コンフィグレーションQSPIフラッシュ (XIP) + OCRAM/ 外部RAM (書き込み可能なデータセクション用) | alt_load() function |
ブートコピアーを使用してコンフィグレーションQSPIフラッシュからRAMにコピーされたNios Vプロセッサー・アプリケーション | OCRAM/ 外部RAM | GSFIブートローダー | |
SDMベースのデバイス3 (Mailbox Client Intel® FPGA IPを使用) | ブートコピアーを使用してコンフィグレーションQSPIフラッシュからRAMにコピーされたNios Vプロセッサー・アプリケーション | OCRAM/ 外部RAM | SDMブートローダー |
セクションの内容
Nios Vプロセッサーのデザイン、コンフィグレーション、およびブートフロー (コントロール・ブロックベースのデバイス)
Nios Vプロセッサーのデザイン、コンフィグレーション、およびブートフロー (SDMベースのデバイス)
3 デバイスリストについては、 Nios® Vプロセッサーのデバイスサポートの表を参照してください。