インテルのみ表示可能 — GUID: jsz1488565703636
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50.3.3. MAC速度
Macの速度情報を使用して、さまざまな送信クロックソースを選択します。
Arria® Vまたは Cyclone® VのHPSコアは、Macの速度情報をFPGAファブリックに提供しません。そのため、コントロール・レジスターがインテルFPGA HPS EMAC Interface Splitterコアで定義されます。それにより、HPS EMACおよびPHYデバイスで使用される速度に応じてそれをソフトウェアで正しくコンフィグレーションします。
インテル® Arria® 10 HPSは、Macの速度情報をFPGAファブリックに提供します。インテルFPGA HPS EMAC Interface Splitterコアのコントロール・レジスターは自動的に削除されます。
インテル FPGA HPS GMII to TSE 1000BASE-X/SGMII PCSブリッジに入る2つの着信mac_speedビットは、非同期かつ静的であるとして扱われます。1ビットのみ (mac_speed[1]) を使用し、MACがGMIIモードで動作しているかMIIモードで動作しているかを特定します。よって、mac_speed[1] の同期には、ダブル・シンクロナイザーで十分です。両方のビットを使用しない限り、追加のフィルタリング・ロジックは必要ありません。