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2.5.1. インテル® Stratix 10® デバイスのレシーバーブロック
インテル® Stratix 10® の差動レシーバーは、次のハードウェア・ブロックを有します。
- DPA ブロック
- シンクロナイザー
- データ・リアライメント・ブロック ( ビットスリップ )
- デシリアライザー
図 8. レシーバーのブロック図次の図は、レシーバーのハードウェア・ブロックを示しています。SDR モードおよび DDR モードでは、IOE からのデータ幅はそれぞれ 1 ビットと 2 ビットです。デシリアライザーはシフトレジスターとパラレル・ロード・レジスターを含んでおり、内部ロジックに最大 10 ビットを送信します。