インテルのみ表示可能 — GUID: szn1612576348432
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1. 頭字語
2. はじめに
3. IPアーキテクチャーと機能の説明
4. 高度な機能
5. インターフェイス
6. パラメーター
7. テストベンチ
8. トラブルシューティング/デバッグ
9. F-タイル Avalon ストリーミング・インテル FPGA IP for PCI Expressユーザーガイドのアーカイブ
10. F-タイル Avalon ストリーミング・インテル FPGA IP for PCI Express ユーザーガイドの改訂履歴
A. コンフィグレーション・スペース・レジスター
B. エンドポイントモードでのアドレス変換サービス(ATS)の実装
C. TLPバイパスモードでユーザー・アプリケーションに転送されるパケット
D. Root Port BFM
E. 独立したリセットに対する分岐エンドポイントのサポート
5.1. このボードについて
5.2. クロックおよびリセット
5.3. シリアル・データ・インタフェース
5.4. Avalon-ST インターフェイス
5.5. 割り込みインターフェイス
5.6. ハードIP Statusインターフェイス
5.7. エラー・インターフェイス
5.8. 10ビットタグサポートインターフェイス
5.9. コンプリーション・タイムアウト・エラー。
5.10. Power Management Interface
5.11. ホット・プラグ・インターフェイス(RPのみ)
5.12. ペイロード出力インターフェイス
5.13. コンフィグレーションインターセプトインターフェイス(EPのみ)
5.14. ハードIPリコンフィグレーション・インターフェイス
5.15. PHYリコンフィグレーション・インターフェイス
5.16. ページリクエストサービス(PRS)インターフェイス(EPのみ)
5.17. FLRインターフェイス信号
5.18. PTMインターフェイス信号
5.19. VFエラー・フラグ・インターフェイス信号
5.20. VirtIOPCIコンフィグレーション・アクセスインターフェイス信号
6.2.3.1. デバイス・ケイパビリティー
6.2.3.2. Link Capabilities
6.2.3.3. Legacy Interrupt Pin Register
6.2.3.4. MSI-X Capabilities
6.2.3.5. MSI-X Capabilities
6.2.3.6. スロット・ケイパビリティー
6.2.3.7. レイテンシー・トレランス・レポート(LTR)
6.2.3.8. Process Address Space ID (PASID)
6.2.3.9. Device Serial Number Capability
6.2.3.10. Page Request Service (PRS)
6.2.3.11. Access Control Service (ACS) Capabilities
6.2.3.12. 消費電力マネジメント
6.2.3.13. Vendor Specific Extended Capability (VSEC)
6.2.3.14. Precision Time Measurement (PTM)
6.2.3.15. Address Translation Services (ATS)
6.2.3.16. TLP Processing Hints (TPH)
6.2.3.17. VirtIOパラメーター
7.6.1. ebfm_barwrプロシージャー
7.6.2. ebfm_barwr_immプロシージャー
7.6.3. ebfm_barrd_waitプロシージャー
7.6.4. ebfm_barrd_nowtプロシージャー
7.6.5. ebfm_cfgwr_imm_waitプロシージャー
7.6.6. ebfm_cfgwr_imm_nowtプロシージャー
7.6.7. ebfm_cfgrd_waitプロシージャー
7.6.8. ebfm_cfgrd_nowtプロシージャー
7.6.9. BFMコンフィグレーション・プロシージャー
7.6.10. BFM共有メモリー・アクセス・プロシージャー
7.6.11. BFMログおよびメッセージ・プロシージャー
7.6.12. Verilog HDL Formattingファンクション
A.3.1. Intel定義のVSEC機能ヘッダー(オフセット00h)
A.3.2. インテル定義のベンダー固有のヘッダー(オフセット04h)
A.3.3. インテルマーカー(オフセット08h)
A.3.4. JTAGシリコンID(オフセット0x0C-0x18)
A.3.5. ユーザー設定可能なデバイスとボードID(オフセット0x1C-0x1D)
A.3.6. General Purpose Control and Status Register - 0xBB0
A.3.7. Uncorrectable Internal Error Status (修正不可能な内部エラーステータス) レジスター - 0xBB4
A.3.8. Uncorrectable Internal Error Mask (修正不可能な内部エラーマスク) レジスター - 0xBB8
A.3.9. Correctable Internal Error Status (修正可能な内部エラーマスク) レジスター - 0xBBC
A.3.10. Correctable Internal Error Mask (修正可能な内部エラーマスク) レジスター
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5.11. ホット・プラグ・インターフェイス(RPのみ)
信号名 | 入力/出力 | EP/RP/BP | クロックドメイン | 説明 |
---|---|---|---|---|
p#_sys_atten_button_pressed_i | 入力 | RP | coreclkout_hip | 注意ボタンが押されました。システムアテンションボタンが押されたことを示し、スロットステータスレジスターのアテンションボタン押されたビットを設定します。 |
p#_sys_pwr_fault_det_i | 入力 | RP | coreclkout_hip | 電源障害が検出されました。電源コントローラがこのスロットで電源障害を検出したことを示します。 |
p#_sys_mrl_sensor_chged_i | 入力 | RP | coreclkout_hip | MRLセンサーが変更されました。 MRLセンサーの状態が変化したことを示します。 |
p#_sys_pre_det_chged_i | 入力 | RP | coreclkout_hip | プレゼンス検出が変更されました。カードプレゼンス検出器の状態が変化したことを示します。 |
p#_sys_cmd_cpled_int_i | 入力 | RP | coreclkout_hip | コマンド完了割り込み。ホットプラグコントローラがコマンドを完了したことを示します。 |
p#_sys_pre_det_state_i | 入力 | RP | coreclkout_hip | カードがスロットにあるかどうかを示します。 0:スロットは空です。 1:カードがスロットにあります。 |
p#_sys_mrl_sensor_state_i | 入力 | RP | coreclkout_hip | MRLセンサーの状態。手動操作の保持ラッチ(MRL)センサーの状態を示します。 0:MRLは閉じています。 1:MRLは開いています。 |
p#_sys_eml_interlock_engaged_i | 入力 | RP | coreclkout_hip | システムの電気機械的インターロックが有効かどうかを示し、スロットステータスレジスターの電気機械的インターロックステータスビットの状態を制御します。 |