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3.1. シミュレーション・フロー
3.2. クロック・インターフェイスとリセット・インターフェイス
3.3. FPGA-to-HPS AXI* スレーブ・インターフェイス
3.4. HPS-to-FPGA AXI* マスター・インターフェイス
3.5. 軽量HPS-to-FPGA AXI* マスター・インターフェイス
3.6. HPS-to-FPGA MPUイベント・インターフェイス
3.7. 割り込みインターフェイス
3.8. HPS-to-FPGAデバッグAPBインターフェイス
3.9. FPGA-to-HPSシステム・トレース・マクロセル (STM) ハードウェア・イベント・インターフェイス
3.10. HPS-to-FPGAクロストリガー・インターフェイス
3.11. HPS-to-FPGAトレース・ポート・インターフェイス
3.12. FPGA-to-HPS DMAハンドシェイク・インターフェイス
3.13. 汎用入力インターフェイス
3.14. EMIFコンジット
3.15. 「HPSコンポーネントのシミュレーション」章の改訂履歴
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2.1. HPSコンポーネントのパラメーター化
- 現在のバージョンの インテル® Quartus® Primeプロ・エディション・デザイン・ソフトウェアを、 インテル® Stratix® 10デバイスサポートとともにインストールします。
- インテル® Quartus® Prime開発ソフトウェアを開きます。
- Tools > プラットフォーム・デザイナー を選択し、プラットフォーム・デザイナーを開きます。
- 既存の インテル® Quartus® Primeプロジェクトとプラットフォーム・デザイナー・システムを選択する、もしくは新しいファイルを作成します。Device Familyドロップダウンの インテル® Stratix® 10と、Device Partドロップダウンの (1SXxxxの形式で表示されている) デバイスが選択されていることを確認してください。
- IP Catalogタブのライブラリーで、 Processors and Peripherals > Hard Processor Systems > Hard Processor System Intel Stratix 10 FPGA IPを選択します。
図 1. プラットフォーム・デザイナーIPカタログ