インテル® Stratix® 10 ハード・プロセッサー・システム (HPS) コンポーネント・リファレンス・マニュアル

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ID 683516
日付 11/30/2018
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ドキュメント目次
ドキュメント目次 x
1. インテル® Stratix® 10 ハード・プロセッサー・システム (HPS) コンポーネントの概要 2. インテル® Stratix® 10ハード・プロセッサー・システム (HPS) コンポーネントのコンフィグレーション 3. インテル® Stratix® 10 HPSコンポーネントのシミュレーション
1. インテル® Stratix® 10 ハード・プロセッサー・システム (HPS) コンポーネントの概要 x
1.1. Cortex*-A53 MPCore* プロセッサー 1.2. CoreSight* デバッグ・コンポーネント 1.3. インターコネクト 1.4. FPGAブリッジ 1.5. メモリー・コントローラー 1.6. サポートされるペリフェラル 1.7. 「HPSコンポーネントの概要」の章の改訂履歴
1.6. サポートされるペリフェラル x
1.6.1. インターフェイス・ペリフェラル 1.6.2. オンチップ・メモリー
2. インテル® Stratix® 10ハード・プロセッサー・システム (HPS) コンポーネントのコンフィグレーション x
2.1. HPSコンポーネントのパラメーター化 2.2. FPGAインターフェイス 2.3. HPSクロックとリセット 2.4. SDRAM 2.5. I/O遅延 2.6. ピンMUXとペリフェラル 2.7. HPSコンポーネントの生成とコンパイル 2.8. アドレス・スパン・エクステンダー・コンポーネントを使用する 2.9. 「HPSコンポーネントのコンフィグレーション」章の改訂履歴
2.2. FPGAインターフェイス x
2.2.1. General Interfaces 2.2.2. HPS-FPGA AXI Bridges 2.2.3. HPS Boot Source 2.2.4. DMAコントローラー・インターフェイス 2.2.5. Interrupts
2.2.1. General Interfaces x
2.2.1.1. MPUスタンバイ・インターフェイスおよびイベント・インターフェイスを有効にする 2.2.1.2. 汎用信号を有効にする 2.2.1.3. デバッグAPBインターフェイスを有効にする 2.2.1.4. システム・トレース・マクロセル (STM) ハードウェア・イベントを有効にする 2.2.1.5. FPGAクロス・トリガー・インターフェイスを有効にする 2.2.1.6. DDR ARMトレースバス (ATB) を有効にする
2.2.2. HPS-FPGA AXI Bridges x
2.2.2.1. FPGA-to-HPSスレーブ・インターフェイス 2.2.2.2. HPS to FPGA AXI-4マスター・インターフェイス 2.2.2.3. 軽量HPS-to-FPGAマスター・インターフェイス 2.2.2.4. FPGA-to-HPS SDRAM AXI* -4スレーブ・インターフェイス
2.2.5. Interrupts x
2.2.5.1. FPGA-to-HPS 2.2.5.2. HPS-to-FPGA
2.3. HPSクロックとリセット x
2.3.1. 入力クロック 2.3.2. 内部クロックと出力クロック 2.3.3. Reset
2.3.1. 入力クロック x
2.3.1.1. 外部クロックソース 2.3.1.2. FPGA-to-HPSクロックソース 2.3.1.3. ペリフェラルFPGAクロック
2.3.2. 内部クロックと出力クロック x
2.3.2.1. Main PLL Output Clocks – Desired Frequencies 2.3.2.2. HPS to FPGA User Clocks 2.3.2.3. HPS Peripheral Clocks – Desired Frequencies 2.3.2.4. Clock Sources 2.3.2.5. PLL Report
2.6. ピンMUXとペリフェラル x
2.6.1. Auto-Place IP 2.6.2. Advanced
3. インテル® Stratix® 10 HPSコンポーネントのシミュレーション x
3.1. シミュレーション・フロー 3.2. クロック・インターフェイスとリセット・インターフェイス 3.3. FPGA-to-HPS AXI* スレーブ・インターフェイス 3.4. HPS-to-FPGA AXI* マスター・インターフェイス 3.5. 軽量HPS-to-FPGA AXI* マスター・インターフェイス 3.6. HPS-to-FPGA MPUイベント・インターフェイス 3.7. 割り込みインターフェイス 3.8. HPS-to-FPGAデバッグAPBインターフェイス 3.9. FPGA-to-HPSシステム・トレース・マクロセル (STM) ハードウェア・イベント・インターフェイス 3.10. HPS-to-FPGAクロストリガー・インターフェイス 3.11. HPS-to-FPGAトレース・ポート・インターフェイス 3.12. FPGA-to-HPS DMAハンドシェイク・インターフェイス 3.13. 汎用入力インターフェイス 3.14. EMIFコンジット 3.15. 「HPSコンポーネントのシミュレーション」章の改訂履歴
3.1. シミュレーション・フロー x
3.1.1. シミュレーションに向けたHPSコンポーネントを設定する 3.1.2. プラットフォーム・デザイナーでのHPSシミュレーション・モデルの生成 3.1.3. シミュレーションの実行
3.1.1. シミュレーションに向けたHPSコンポーネントを設定する x
3.1.1.1. FPGAに接続するHPSコンジット・インターフェイス
3.1.3. シミュレーションの実行 x
3.1.3.1. HPS RTLシミュレーションの実行 3.1.3.2. HPSポストフィット・シミュレーションの実行
3.1.3.2. HPSポストフィット・シミュレーションの実行 x
3.1.3.2.1. ポストフィット・シミュレーション・ファイル 3.1.3.2.2. BFM APIの階層フォーマット
3.2. クロック・インターフェイスとリセット・インターフェイス x
3.2.1. クロック・インターフェイス 3.2.2. リセット・インターフェイス
1. インテル® Stratix® 10 ハード・プロセッサー・システム (HPS) コンポーネントの概要
2. インテル® Stratix® 10ハード・プロセッサー・システム (HPS) コンポーネントのコンフィグレーション
3. インテル® Stratix® 10 HPSコンポーネントのシミュレーション

2.2.5.2. HPS-to-FPGA

表 3.  HPS-to-FPGA割り込みインターフェイス次の表は、利用可能なHPS to FPGA割り込みインターフェイスと、それらが有効になっている際に利用できるインターフェイスを示します。
パラメーター名 パラメーターの説明 インターフェイス名
Enable Clock Peripheral Interrupts HPSクロック・マネージャーおよびFPGAへのMPUウェイクアップ割り込み信号のインターフェイスを有効にします。

h2f_clkmgr_interrupt

h2f_mpuwakeup_interrupt

Enable DMA Interrupts HPS DMA チャネル割り込みインターフェイスおよびFPGAへのDMAアボート割り込みを有効にします。

h2f_dma_interrupt0

h2f_dma_interrupt1

h2f_dma_interrupt2

h2f_dma_interrupt3

h2f_dma_interrupt4

h2f_dma_interrupt5

h2f_dma_interrupt6

h2f_dma_interrupt7

h2f_dma_abort_interrupt

Enable EMAC Interrupts FPGAへのHPSイーサネットMACコントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、EMACをPin Muxタブで有効にする必要があります。

h2f_emac0_interrupt

h2f_emac1_interrupt

h2f_emac2_interrupt

Enable GPIO Interrupts FPGAへのHPS汎用IO (GPIO) 割り込みインターフェイスを有効にします。

h2f_gpio0_interrupt

h2f_gpio1_interrupt

h2f_gpio2_interrupt

Enable I2C-EMAC Interrupts I2CEMACのHPSペリフェラル割り込みがFPGA ファブリックへ駆動されるようにします。

h2f_i2c_emac0_interrupt

h2f_i2c_emac1_interrupt

h2f_i2c_emac2_interrupt

Enable I2C Peripherals Interrupts I2C0のHPSペリフェラル割り込みがFPGA ファブリックへ駆動されるようにします。割り込みを有効にする前に、Pin MuxタブでI2Cを有効にする必要があります。

h2f_i2c0_interrupt

h2f_i2c1_interrupt

Enable L4 Timer Interrupts L4TIMERのHPSペリフェラル割り込みがFPGA ファブリックへ駆動されるようにします。

h2f_timer_l4sp_0_interrupt

h2f_timer_l4sp_1_interrupt

Enable NAND Interrupts FPGAへのHPS NANDコントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、Pin MuxタブでNAND IPブロックを有効にする必要があります。

h2f_nand_interrupt

Enable SYS Timer Interrupts SYSTIMERのHPSペリフェラル割り込みがFPGA ファブリックに駆動されるようにします。

h2f_timer_sys_0_interrupt

h2f_timer_sys_1_interrupt

Enable SD/MMC Interrupts FPGAへのHPS SD/MMCコントローラー割り込みインターフェイスを有効にします。 割り込みを有効にする前に、Pin MuxタブでSD/MMC IPブロックを有効にする必要があります。

h2f_sdmmc_interrupt

Enable SPI Master Interrupts FPGAへのHPS SPIマスター・コントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、Pin MuxタブでSPIマスターIPブロックを有効にする必要があります。

h2f_spim0_interrupt

h2f_spim1_interrupt

Enable SPI Slave Interrupts FPGAへのHPS SPIスレーブ・コントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、Pin MuxタブでSPI IPブロックを有効にする必要があります。

h2f_spis0_interrupt

h2f_spis1_interrupt

Enable ECC/Parity_L1 Interrupts ECCシングルおよびダブル・ビット・エラーと、L1パリティーエラーのHPSペリフェラル割り込みがFPGA ファブリックに駆動されるようにします。

h2f_ecc_serr_interrupt

h2f_ecc_derr_interrupt

h2f_parity_l1_interrupt

Enable UART Interrupts FPGAへのHPS UARTコントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、Pin MuxタブでUART IPブロックを有効にする必要があります。

h2f_uart0_interrupt

h2f_uart1_interrupt

Enable USB Interrupts FPGAへのHPS USBコントローラー割り込みインターフェイスを有効にします。割り込みを有効にする前に、Pin MuxタブでUSB IPブロックを有効にする必要があります。

h2f_usb0_interrupt

h2f_usb1_interrupt

Enable Watchdog Interrupts FPGAへのHPSウォッチドッグ割り込みインターフェイスを有効にします。

h2f_wdog0_interrupt

h2f_wdog1_interrupt

レベル 2 の表題