インテルのみ表示可能 — GUID: bhc1410937291121
Ixiasoft
5.3.1. ラインの挿入
5.3.2. CRCの挿入/チェック
5.3.3. ペイロードIDの挿入
5.3.4. TRSの一致
5.3.5. スクランブラー
5.3.6. TXサンプル
5.3.7. クロック・イネーブル・ジェネレーター
5.3.8. RXサンプル
5.3.9. ビデオ規格の検出
5.3.10. 検出1および1/1.001レート
5.3.11. トランシーバー・コントローラー
5.3.12. デスクランブラー
5.3.13. TRSアライナー
5.3.14. 3Gb Demux
5.3.15. ラインの抽出
5.3.16. ペイロードIDの抽出
5.3.17. フォーマットの検出
5.3.18. ストリームの同期
5.3.19. SDビットの変換
5.3.20. 同期ビットの挿入
5.3.21. 同期ビットの削除
7.1.2.1. トランシーバーのNative PHY IPコアでのRX CDRリファレンス・クロックの変更
7.1.2.2. 同じチャネル内でのシンプレックス・モード・トランシーバーの結合
7.1.2.3. トリプルレートおよびマルチレートに対する生成されたリコンフィグレーション管理の使用
7.1.2.4. 同じチャネル内での独立したRXおよびTX動作の確保
7.1.2.5. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスのフィッター段階での潜在的な配線問題
7.1.2.6. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスを使用したSDIマルチレートRXの制約のないクロック
7.1.2.7. 未使用のトランシーバー・チャネル
7.1.2.8. インテル® Stratix® 10デバイスのコアロジックへのトランシーバー・リファレンス・クロック・ピンの配線
インテルのみ表示可能 — GUID: bhc1410937291121
Ixiasoft
8.2.2.4. リコンフィグレーション・ルーター信号
次の表に、リコンフィグレーション・ルーターの信号を示します。
信号 | 幅 | 入力/出力 | 説明 |
---|---|---|---|
ch1_<direction>_tx_start_reconfig | 1 | 入力 | チャネル1のトランスミッターまたは二重インスタンスでのTX PLLダイナミック切り替えのダイナミック・リコンフィグレーション要求信号です。 |
ch1_<direction>_tx_pll_sel | 1 | 入力 | トランスミッターまたはチャネル1の二重インスタンスでのTX PLLダイナミック切り替え用のTX PLL選択信号。この信号は、SDIインスタンスの xcvr_refclk_sel 信号にも接続されます。 |
ch1_<direction>_tx_reconfig_done | 1 | 出力 | トランスミッターまたはチャネル1の二重インスタンスでのTX PLLダイナミック切り替えのダイナミック・リコンフィグレーション・アクノリッジ信号です。 |