インテルのみ表示可能 — GUID: bhc1410937388179
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5.3.1. ラインの挿入
5.3.2. CRCの挿入/チェック
5.3.3. ペイロードIDの挿入
5.3.4. TRSの一致
5.3.5. スクランブラー
5.3.6. TXサンプル
5.3.7. クロック・イネーブル・ジェネレーター
5.3.8. RXサンプル
5.3.9. ビデオ規格の検出
5.3.10. 検出1および1/1.001レート
5.3.11. トランシーバー・コントローラー
5.3.12. デスクランブラー
5.3.13. TRSアライナー
5.3.14. 3Gb Demux
5.3.15. ラインの抽出
5.3.16. ペイロードIDの抽出
5.3.17. フォーマットの検出
5.3.18. ストリームの同期
5.3.19. SDビットの変換
5.3.20. 同期ビットの挿入
5.3.21. 同期ビットの削除
7.1.2.1. トランシーバーのNative PHY IPコアでのRX CDRリファレンス・クロックの変更
7.1.2.2. 同じチャネル内でのシンプレックス・モード・トランシーバーの結合
7.1.2.3. トリプルレートおよびマルチレートに対する生成されたリコンフィグレーション管理の使用
7.1.2.4. 同じチャネル内での独立したRXおよびTX動作の確保
7.1.2.5. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスのフィッター段階での潜在的な配線問題
7.1.2.6. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスを使用したSDIマルチレートRXの制約のないクロック
7.1.2.7. 未使用のトランシーバー・チャネル
7.1.2.8. インテル® Stratix® 10デバイスのコアロジックへのトランシーバー・リファレンス・クロック・ピンの配線
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5.3.6. TXサンプル
TXサンプル・サブモジュールは、送信オーバーサンプリング・ブロックです。入力ワードの各ビットを指定された回数繰り返し、出力ワードを構築します。
このサブモジュールは、入力データがクロックサイクルの1/xでのみ有効であるという事実に依存しています (xは、オーバーサンプリング係数)。入力ワードと出力ワードは、両方とも同じクロックドメインからクロック供給されます。
リアル・ビデオ・レートとIPモードの比較 | SD-SDI | HD-SDI | Dual-Rate | Triple-Rate | Multi-Rate |
---|---|---|---|---|---|
SD-SDI | 11 | 適用なし | 11 | 11 | 44 |
HD-SDI | 適用なし | - | 2 | 2 | 8 |
3G-SDI | 適用なし | 適用なし | 適用なし | 適用なし | 4 |
6G-SDI | 適用なし | 適用なし | 適用なし | 適用なし | 2 |
12G-SDI | 適用なし | 適用なし | 適用なし | 適用なし | - |