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5.3.1. ラインの挿入
5.3.2. CRCの挿入/チェック
5.3.3. ペイロードIDの挿入
5.3.4. TRSの一致
5.3.5. スクランブラー
5.3.6. TXサンプル
5.3.7. クロック・イネーブル・ジェネレーター
5.3.8. RXサンプル
5.3.9. ビデオ規格の検出
5.3.10. 検出1および1/1.001レート
5.3.11. トランシーバー・コントローラー
5.3.12. デスクランブラー
5.3.13. TRSアライナー
5.3.14. 3Gb Demux
5.3.15. ラインの抽出
5.3.16. ペイロードIDの抽出
5.3.17. フォーマットの検出
5.3.18. ストリームの同期
5.3.19. SDビットの変換
5.3.20. 同期ビットの挿入
5.3.21. 同期ビットの削除
7.1.2.1. トランシーバーのNative PHY IPコアでのRX CDRリファレンス・クロックの変更
7.1.2.2. 同じチャネル内でのシンプレックス・モード・トランシーバーの結合
7.1.2.3. トリプルレートおよびマルチレートに対する生成されたリコンフィグレーション管理の使用
7.1.2.4. 同じチャネル内での独立したRXおよびTX動作の確保
7.1.2.5. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスのフィッター段階での潜在的な配線問題
7.1.2.6. インテル® Arria® 10および インテル® Cyclone® 10 GXデバイスを使用したSDIマルチレートRXの制約のないクロック
7.1.2.7. 未使用のトランシーバー・チャネル
7.1.2.8. インテル® Stratix® 10デバイスのコアロジックへのトランシーバー・リファレンス・クロック・ピンの配線
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2.3. 概要
SMPTEは、ビデオ制作施設内の機器間の相互接続として広く使用されているSDI規格を定義しています。SDI II IPコアでは、次のSDIデータレートを処理できます。
- 270メガビット/秒 (Mbps) SD-SDI (SMPTE ST 259-1997 10-Bit 4:2:2 Component Serial Digital Interfaceで定義)
- 1.485ギガビット/秒 (Gbps) または1.4835Gbps HD-SDI (SMPTE ST 292-1998 Bit-Serial Digital Interface for High Definition Television Systemsで定義)
- 2.97Gbpsまたは2.967Gbps 3G-SDI (SMPTE ST 424で定義)
- 5.94Gbpsまたは5.934Gbps 6G-SDI (SMPTE ST 2081で定義)
- 11.88Gbpsまたは11.868Gbps 12G-SDI (SMPTE ST 2082で定義)
デバイスファミリー | SDIビデオ規格 | |||||||
---|---|---|---|---|---|---|---|---|
シングルレート | マルチレート | |||||||
SD-SDI | HD-SDI | 3G-SDI | 12G-SDI | デュアルリンクHD-SDI | デュアルレート (最大HD) | トリプルレート (最大3G) | マルチレート (最大12G) | |
Arria V GX/GT/SX/ST | あり | あり | あり | なし | あり | あり | あり | なし |
Arria V GZ | あり | あり | あり | なし | あり | あり | あり | なし |
Stratix V | あり | あり | あり | なし | あり | あり | あり | なし |
Cyclone V | あり | あり | あり | なし | あり | あり | あり | なし |
インテル® Arria® 10 | なし | あり | あり | なし | なし | なし | あり | あり |
インテル® Stratix® 10 | なし | あり | あり | なし | なし | なし | あり | あり |
インテル® Cyclone® 10 GX | なし | あり | あり | なし | なし | なし | あり | あり |
Intel Agilex® 7 Fタイル | なし | あり | あり | なし | なし | なし | あり | あり |