インテルのみ表示可能 — GUID: mwh1410471208444
Ixiasoft
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5.5.3.1. Timing Analyzerによるパスレポートの表示
いずれかのクロックドメインに障害のあるパス(Reportペインで赤で強調表示)がある場合、Clocks Summaryペインに表示されているクロック名を右クリックし、タイミングのレポートをクリックして詳細を表示します。
Summary of Pathsタブでパスを選択すると、パス詳細ペインにすべてのパス情報が表示されます。Extra Fitter Informationタブには、物理デバイス上のパスの場所が視覚的に表示されます。 これにより、送信元ノードと宛先ノードが近すぎるか遠すぎるかに起因して、タイミング障害が距離に関連しているかどうかがわかります。 Extra Fitter Informationタブは インテル® Stratix® 10デバイスには使用できません。
Data Pathタブに、Data Arrival PathとData Required Pathが表示されます。 増分情報を使用して、タイミング違反に最も寄与しているパスセグメントを特定できます。Waveformタブには、時間領域の信号が表示され、到着データと必要なデータ間のスラックがプロットされます。
Technology Map Viewerは、回路図でテクノロジー・マップされたデザイン・ネットリストの表現を提供し、デザイン内のどの領域がロジックレベルの数を減らすことによって利益を得られるかを評価するのに役立ちます。 いずれかのビューアでタイミングパスを見つけるには、タイミングレポート内のパスを右クリックし、Locate PathをポイントしLocate in Technology Map Viewerを選択します。 Chip Plannerを使用して、パスの物理レイアウトを詳細に調査することもできます。