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2.1. MAX® 10外部メモリー・インターフェイスのI/Oバンク
2.2. MAX® 10 DQ/DQSグループ
2.3. MAX® 10 外部メモリ・インタフェースの最大幅
2.4. MAX 10メモリ・コントローラ
2.5. MAX® 10外部メモリ・リード・データパス
2.6. MAX® 10 外部メモリ・ライト・データパス
2.7. MAX® 10アドレス/コマンド・パス
2.8. MAX® 10PHYクロック(PHYCLK)ネットワーク
2.9. VTトラッキングの位相検出器
2.10. オンチップ直列終端
2.11. フェーズ・ロック・ループ
2.12. MAX® 10の低消費電力機能
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1.1. MAX® 10外部メモリ・インタフェースのサポートと性能
MAX® 10デバイスは、複数の外部メモリ・インタフェース規格をサポートする回路が含まれています。
外部メモリ・インタフェースの規格 | レート・サポート | スピード・グレード | 電圧(V) | 最大周波数(MHz) |
---|---|---|---|---|
DDR3 SDRAM | ハーフ | -I6 | 1.5 | 303 |
DDR3L SDRAM | ハーフ | -I6 | 1.35 | 303 |
DDR2 SDRAM | ハーフ | -I6 | 1.8 | 200 |
-I7および-C7 | 167 | |||
LPDDR2 2 | ハーフ | -I6 | 1.2 | 200 3 |
2 MAX® 10デバイスは、シングル・ダイのLPDDR2のみをサポートします。
3 指定の性能を達成するには、メモリ・デバイスI/Oとコアの電源変動の共有を±3%に制約します。周波数はデフォルトで167MHzです。