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4.3. LVDSレシーバ用FPGAデザインの実装
MAX® 10デバイスでは、高速I/OインタフェースをサポートするためにソフトSERDESアーキテクチャを使用しています。 Quartus® Primeソフトウェアが、アルテラのソフトLVDS IPコアを使用してコア・ファブリックにSERDES回路を作成します。タイミング性能を向上させ、SERDESをサポートするために、 MAX® 10デバイスではコア・ファブリックのI/OレジスタとLEレジスタを使用します。