各 CSR レジスタの値によって、CSR の状態が決まります。 Nios® V/m プロセッサー。フィールドの説明は RISC-V 仕様に基づいています。
表 43. Statusレジスターのフィールドの mステータス register は、ハートの現在の動作状態を追跡および制御する 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
SD |
WPRI |
TSR |
TW |
TVM |
MXR |
合計 |
MPRV |
XS[1:0] |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
XS[1:0] |
FS[1:0] |
MPP[1:0] |
WPRI |
SPP |
MPIE |
WPRI |
スパイ |
ユーピー |
mie |
WPRI |
SIE |
UIE |
表 44. マシン ISA レジスタのフィールドの ミサ CSR は、ハートによってサポートされる ISA を報告する読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
MXL[1:0] |
WLRL |
[25..0] |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
[25..0] |
表 45. マスター割り込みイネーブルレジスターのフォーマットの 三重 register は、割り込みイネーブル ビットを含む 32 ビットの読み書き可能なレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
WPRI |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
WPRI |
メイエ |
WPRI |
セイエ |
うえいえ |
MTIE |
WPRI |
STIE |
ユティ |
MSIE |
WPRI |
SSIE |
USIE |
表 46. マシン トラップ ハンドラのベース アドレス レジスタのフィールドの ムトベック register は、ベクトル ベース アドレス (BASE) とベクトル モード (MODE) で構成されるトラップ ベクトル構成を保持する 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
ベース + 31 |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
ベース + 31 |
Mode |
表 47. マシン例外プログラム カウンター レジスタ フィールドの メパソコン register は、トラップが M モードに取り込まれたときに割り込まれた命令、または例外が発生した命令のアドレスを保持する 32 ビットの読み書き可能なレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
メパソコン |
表 48. マシントラップ原因レジスタフィールドの だって register は、トラップが M モードに取り込まれたときに、トラップを引き起こしたイベントを示すコードを保持する 32 ビットの読み書き可能なレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
割り込み |
例外コード [30:16] |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
例外コード [15:0] |
表 49. マシントラップ値レジスタフィールドの MTVAL register は、トラップが M モードに取り込まれたときにソフトウェアがトラップを処理するのを支援するために、例外固有の情報が書き込まれる 32 ビットの読み書き可能レジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
MTVAL |
表 50. マシン割り込み保留レジスタのフィールドの ミップ register は、保留中の割り込みに関する情報を含む 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
WPRI |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
WPRI |
メイプ |
WPRI |
SEIP |
UEIP |
MTIP |
WPRI |
スティップ |
UTIP |
MSIP |
WPRI |
SSIP |
USIP |
表 51. トリガー選択レジスタフィールドの 選択する register は、他のトリガー レジスタからアクセスできる現在のトリガーを選択する 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
選択する |
表 52. トリガーデータ 1 (一致制御) レジスタフィールドの tdata1 (mcontrol) register は、トリガー タイプ、tdata レジスタのアクセス可能性、およびトリガーの実装に関する情報を含む 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
タイプ=2 |
dモード |
マスクマックス |
打つ |
「選択 (select)」 |
timing |
サイズロ |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
action |
鎖 |
マッチ |
m |
0 |
s |
u |
Execute |
店 |
ロード |
表 53. トリガーデータ 2 レジスタフィールドの tdata2 register は、トリガー固有のデータを含む 32 ビットの読み取り/書き込みレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
を更新。 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
tdata2 |
表 54. トリガー情報レジスタのフィールドの tinfo register は、考えられる各 tdata1.type に関する情報を含む 32 ビットの読み取り専用レジスタです。
ビットフィールド |
31 |
30 |
29 |
を更新。 |
18 |
17 |
16 |
15 |
14 |
13 |
を更新。 |
2 |
1 |
0 |
0 |
Info |
表 55. PMAコントロール・レジスターおよびステータス・レジスター・マップの dcsr CSR は、D モード中の情報とステータスを含む 32 ビットの読み書き可能なレジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
デバッグバー |
0 |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
イーブレーク |
0 |
ブレイク |
エブレイク |
ステピー |
ストップカウント |
停止時間 |
CAUSE: |
0 |
改善しました |
んみっぷ |
ステップ |
prv |
表 56. デバッグ プログラム カウンター レジスタ フィールドDモードに入ると、 dpc CSR は、次に実行される命令の仮想アドレスで更新されます。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
dpc |
表 57. ベンダー ID レジスタのフィールドの ムベンドリッド CSR は、コアのプロバイダーの JEDEC メーカー ID を提供する 32 ビットの読み取り専用レジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
24 |
23 |
22 |
21 |
20 |
19 |
18 |
17 |
16 |
バンク |
15 |
14 |
13 |
12 |
11 |
10 |
9 |
8 |
7 |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
バンク |
Offset |
表 58. アーキテクチャ ID レジスタのフィールドの マーキッド CSR は、ハートの基本マイクロアーキテクチャをエンコードする 32 ビットの読み取り専用レジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
Architecture |
表 59. 実装 ID レジスタのフィールドの 意地悪な CSR は、プロセッサ実装のバージョンの一意のエンコーディングを提供します。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
実装 |
表 60. ハードウェア スレッド ID レジスタのフィールドの マルティッド CSR は、コードを実行しているハードウェア スレッドの整数 ID を含む 32 ビットの読み取り専用レジスタです。
ビットフィールド |
31 |
30 |
29 |
28 |
27 |
26 |
25 |
... |
6 |
5 |
4 |
3 |
2 |
1 |
0 |
ハートID |