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2.1. インテルFPGA IPコアの紹介
2.2. Intel® FPGA IPコアのインストールとライセンス取得
2.3. IPコアのパラメーターとオプションの指定 ( インテル® Quartus® Primeプロ・エディション)
2.4. IPコア生成の出力 (インテルQuartus Primeプロ・エディション)
2.5. インテルIPコア用に生成されるファイル (従来のパラメーター・エディター)
2.6. インテルFPGA IPコアのシミュレーション
2.7. デザイン階層と一致するSignal Tapデバッグファイルの作成
2.8. LL Ethernet 10G MAC Intel® FPGA IPコアのパラメーター設定
2.9. LL Ethernet 10G MAC Intel® FPGA IPコアのアップグレード
2.10. LL Ethernet 10G MAC Intel® FPGA IPコアのデザインの考慮事項
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5.1.1. 10Gbps Ethernet MACレジスターからLL Ethernet 10G MACレジスターへのマッピング
この表を使用して、従来のEthernet 10 Gbps MACレジスターをLL Ethernet 10G MACレジスターにマッピングします。
レジスター名 (10Gbps Ethernet MAC) | オフセット (10Gbps Ethernet MAC) |
オフセット (LL Ethernet 10G MAC) |
---|---|---|
MAC TX Configurationレジスター | ||
TX Packet Control | 1000 | 020 |
TX Transfer Status | 1001 | 使用しない |
TX Pad Insertion Control | 1040 | 024 |
TX CRC Insertion Control | 1080 | 026 |
TX Packet Underflow Count[31:0] | 10C0 | 03E |
TX Packet Underflow Count[35:32] | 10C1 | 03F |
TX Preamble Pass-Through Mode Control | 1100 | 028 |
TX Unidirectional | 1120 | 070 |
TX Pause Frame Control | 1140 | 040 |
TX Pause Frame Quanta | 1141 | 042 |
TX Pause Frame Enable | 1142 | 044 |
TX PFC0 Pause Quanta | 1180 | 048 |
TX PFC1 Pause Quanta | 1181 | 049 |
TX PFC2 Pause Quanta | 1182 | 04A |
TX PFC3 Pause Quanta | 1183 | 04B |
TX PFC4 Pause Quanta | 1184 | 04C |
TX PFC5 Pause Quanta | 1185 | 04D |
TX PFC6 Pause Quanta | 1186 | 04E |
TX PFC7 Pause Quanta | 1187 | 04F |
TX PFC0 Hold-off Quanta | 1190 | 058 |
TX PFC1 Hold-off Quanta | 1191 | 059 |
TX PFC2 Hold-off Quanta | 1192 | 05A |
TX PFC3 Hold-off Quanta | 1193 | 05B |
TX PFC4 Hold-off Quanta | 1194 | 05C |
TX PFC5 Hold-off Quanta | 1195 | 05D |
TX PFC6 Hold-off Quanta | 1196 | 05E |
TX PFC7 Hold-off Quanta | 1197 | 05F |
TX PFC Enable | 11A0 | 046 |
TX Address Insertion Control | 1200 | 02A |
TX Address Insertion MAC Address[31:0] |
1201 | 010 |
TX Address Insertion MAC MAC Address[47:32] |
1202 | 011 |
TX Maximum Frame Length | 1801 | 02C |
MAC RX Configurationレジスター | ||
RX Transfer Control | 0000 | 0A0 |
RX Transfer Status | 0001 | 使用しない |
RX Pad/CRC Control | 0040 | 0A4 |
RX CRC Check Control | 0080 | 0A6 |
RX Overflow Truncated Packet Count[31:0] | 00C0 | 0FC |
RX Overflow Truncated Packet Count[35:32] | 00C1 | 0FD |
RX Overflow Dropped Packet Count[31:0] | 00C2 | 0FE |
RX Overflow Dropped Packet Count[35:32] | 00C3 | 0FF |
RX Preamble Forward Control | 0100 | 0A8 |
RX Preamble Pass-Through Mode Control | 0140 | 0AA |
RX Frame Filtering Control | 0800 | 0AC |
RX Maximum Frame Length | 0801 | 0AE |
RX Frame MAC Address[31:0] |
0802 | 010 |
RX Frame MAC Address[47:32] |
0803 | 011 |
RX Supplementary Address 0[31:0] | 0804 | 0B0 |
RX Supplementary Address 0[47:32] | 0805 | 0B1 |
RX Supplementary Address 1[31:0] | 0806 | 0B2 |
RX Supplementary Address 1[47:32] | 0807 | 0B3 |
RX Supplementary Address 2[31:0] | 0808 | 0B4 |
RX Supplementary Address 2[47:32] | 0809 | 0B5 |
RX Supplementary Address 3[31:0] | 080A | 0B6 |
RX Supplementary Address 3[47:32] | 080B | 0B7 |
RX PFC Control | 0818 | 0C0 |
TX Time Stampレジスター | ||
TX Period for 10G | 1110 | 100 |
TX Fractional Nano-second Adjustment for 10G | 1112 | 102 |
TX Nano-second Adjustment for 10G | 1113 | 104 |
TX Period for 10M/100M/1G | 1118 | 108 |
TX Fractional Nano-second Adjustment for 10M/100M/1G/2.5G | 111A | 10A |
TX Nano-second Adjustment for 10M/100M/1G/2.5G | 111B | 10C |
RX Time Stampレジスター | ||
RX Period for 10G | 0110 | 120 |
RX Fractional Nano-second Adjustment for 10G | 0112 | 122 |
RX Nano-second Adjustment for 10G | 0113 | 124 |
RX Period for 10M/100M/1G | 0118 | 128 |
RX Fractional Nano-second Adjustment for 10M/100M/1G/2.5G | 011A | 12A |
RX Nano-second Adjustment for 10M/100M/1G/2.5G | 011B | 12C |
すべてのTX Statisticsレジスター | 1Cxx | 14x |
すべてのRX Statisticsレジスター | 0Cxx | 1Cx |
Statusレジスター | ||
ECC Error Status |
適用なし | 240 |
ECC Error Enable |
適用なし | 241 |