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2.1. インテルFPGA IPコアの紹介
2.2. Intel® FPGA IPコアのインストールとライセンス取得
2.3. IPコアのパラメーターとオプションの指定 ( インテル® Quartus® Primeプロ・エディション)
2.4. IPコア生成の出力 (インテルQuartus Primeプロ・エディション)
2.5. インテルIPコア用に生成されるファイル (従来のパラメーター・エディター)
2.6. インテルFPGA IPコアのシミュレーション
2.7. デザイン階層と一致するSignal Tapデバッグファイルの作成
2.8. LL Ethernet 10G MAC Intel® FPGA IPコアのパラメーター設定
2.9. LL Ethernet 10G MAC Intel® FPGA IPコアのアップグレード
2.10. LL Ethernet 10G MAC Intel® FPGA IPコアのデザインの考慮事項
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5.4. MAC Reset Controlレジスター
このレジスターは、10G、1G/10G、および10M/100M/1G/10Gの動作モードでのみ使用されます。
ワードオフセット | レジスター名 | 説明 | アクセス | HWリセット値 |
---|---|---|---|---|
0x001F 0x08FF |
mac_reset_control | ユーザー・アプリケーションは、このレジスターの指定されたビットを使用して、MACデータパスをリセットできます。その効果は、tx_rst_n 信号または rx_rst_n 信号をアサートするのと同じです。
Use legacy Ethernet 10G MAC Avalon memory-mapped interfaceをオンにすると、ワードオフセットは 0x08FF になります。それ以外の場合、ワードオフセットは 0x001F です。 |
RW | 0x0 |