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1. Intel Agilex® 7 FシリーズおよびIシリーズ汎用I/Oの概要
2. Intel Agilex® 7 FシリーズおよびIシリーズのGPIOバンク
3. Intel Agilex® 7 FシリーズおよびIシリーズのHPS I/Oバンク
4. Intel Agilex® 7 FシリーズおよびIシリーズのSDM I/Oバンク
5. Intel Agilex® 7 FシリーズおよびIシリーズI/Oトラブルシューティングのガイドライン
6. Intel Agilex® 7 FシリーズおよびIシリーズ汎用I/OのIP
7. プログラマブルI/O機能の説明
8. Intel Agilex® 7汎用I/Oユーザーガイド: FシリーズおよびIシリーズに関連するドキュメント
9. Intel Agilex® 7汎用I/Oユーザーガイド: FシリーズおよびIシリーズの改訂履歴
2.5.1. VREFソースと VREF ピン
2.5.2. VCCIO_PIO電圧に基づくI/O規格の実装
1.2 V VCCIO_PIO
1.5 V VCCIO_PIO
2.5.3. OCTキャリブレーション・ブロック要件
2.5.4. I/Oピンの配置要件
2.5.5. I/O規格の選択とI/Oバンク供給の互換性チェック
2.5.6. 同時スイッチング・ノイズ
2.5.7. 特別なピンの要件
2.5.8. 外部メモリー・インターフェイスのピン配置要件
2.5.9. HPS共有I/Oの要件
2.5.10. クロッキング要件
2.5.11. SDM共有I/Oの要件
2.5.12. 未使用ピン
2.5.13. 未使用のGPIOバンクの電圧設定
2.5.14. 電源シーケンス中のGPIOピン
2.5.15. GPIO入力ピンのドライブ強度の要件
2.5.16. 最大DC電流制限
2.5.17. 1.2 V I/Oインターフェイスの電圧レベルの互換性
2.5.18. Avalon® Streamingインターフェイス・コンフィグレーション・スキームのGPIOピン
2.5.19. I/Oレーンあたりの最大真の差動信号のレシーバーペア
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2.5.2. VCCIO_PIO電圧に基づくI/O規格の実装
次のガイドラインは、VCCIO_PIO電圧に基づくI/O規格に適用されます。
1.2 V VCCIO_PIO
1.2 V VCCIO_PIOを使用すると、シングルエンドの非電圧リファレンス形式および電圧リファレンス形式のI/O規格を実装できます。1.2 Vバッファーは、差動電圧リファレンス形式のI/Oおよび真の差動入力規格もサポートします。
I/Oバンク内で、電圧リファレンス形式のI/Oと非電圧リファレンス形式のI/Oの両方、および真の差動入力規格を組み合わせて実装できます。
1.5 V VCCIO_PIO
1.5 V VCCIO_PIO電圧を使用する場合、True Differential Signaling I/O規格のみを実装できます。バッファーは、FシリーズおよびIシリーズ FPGAの電気的仕様と互換性のあるアップストリーム・デバイスまたはダウンストリーム・デバイスとインターフェイスできます。
電気的仕様要件を解析して、真の差動レシーバーを実装します。
DC結合を実装するのは、信号振幅とオフセット電圧の要件がFシリーズおよびIシリーズTrue Differential Signaling規格仕様の範囲内である場合です。それ以外の場合は、AC結合と外部バイアス回路を実装します。