Nios® Vプロセッサー・リファレンス・マニュアル

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ID 683632
日付 5/26/2023
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ドキュメント目次
ドキュメント目次 x
1. 概要 2. Nios® V/mプロセッサー 3. Nios® V/gプロセッサー 4. Nios Vプロセッサー・リファレンス・マニュアルのアーカイブ 5. Nios® Vプロセッサー・リファレンス・マニュアルの改訂履歴
1. 概要 x
1.1. インテル® Quartus® Prime開発ソフトウェアのサポート
2. Nios® V/mプロセッサー x
2.1. プロセッサーのパフォーマンス・ベンチマーク 2.2. プロセッサーのパイプライン 2.3. プロセッサーのアーキテクチャー 2.4. プログラミング・モデル 2.5. コアの実装
2.3. プロセッサーのアーキテクチャー x
2.3.1. 汎用レジスターファイル 2.3.2. 算術論理演算装置 2.3.3. リセット信号とデバッグ信号 2.3.4. コントロール・ステータス・レジスター 2.3.5. 例外コントローラー 2.3.6. 割り込みコントローラー 2.3.7. メモリーおよびI/Oの構成 2.3.8. RISC-Vベースのデバッグモジュール
2.3.6. 割り込みコントローラー x
2.3.6.1. タイマーおよびソフトウェア割り込みモジュール
2.3.7. メモリーおよびI/Oの構成 x
2.3.7.1. 命令バスおよびデータバス 2.3.7.2. Address Map
2.3.7.1. 命令バスおよびデータバス x
2.3.7.1.1. 命令マネージャー・ポート 2.3.7.1.2. データ・マネージャー・ポート
2.3.8. RISC-Vベースのデバッグモジュール x
2.3.8.1. デバッグモード 2.3.8.2. デバッグモジュールからの停止 2.3.8.3. トリガー 2.3.8.4. デバッグモードの抽象コマンド 2.3.8.5. ハードウェア/ソフトウェア・インターフェイス
2.4. プログラミング・モデル x
2.4.1. 特権レベル 2.4.2. コントロール・ステータス・レジスター (CSR) のマッピング
2.4.1. 特権レベル x
2.4.1.1. マシンモード (Mモード) 2.4.1.2. デバッグモード (Dモード)
2.4.2. コントロール・ステータス・レジスター (CSR) のマッピング x
2.4.2.1. コントロール・ステータス・レジスターのフィールド
2.5. コアの実装 x
2.5.1. 命令セットのリファレンス
3. Nios® V/gプロセッサー x
3.1. プロセッサーのパフォーマンス・ベンチマーク 3.2. プロセッサーのパイプライン 3.3. プロセッサーのアーキテクチャー 3.4. プログラミング・モデル 3.5. コアの実装
3.3. プロセッサーのアーキテクチャー x
3.3.1. 汎用レジスターファイル 3.3.2. 算術論理演算装置 3.3.3. 乗除算ユニット 3.3.4. カスタム命令 3.3.5. リセット信号とデバッグ信号 3.3.6. コントロール・ステータス・レジスター 3.3.7. 例外コントローラー 3.3.8. 割り込みコントローラー 3.3.9. メモリーおよびI/Oの構成 3.3.10. RISC-Vベースのデバッグモジュール
3.3.8. 割り込みコントローラー x
3.3.8.1. タイマーおよびソフトウェア割り込みモジュール
3.3.9. メモリーおよびI/Oの構成 x
3.3.9.1. 命令バスおよびデータバス 3.3.9.2. アドレスマップ 3.3.9.3. キャッシュメモリー
3.3.9.1. 命令バスおよびデータバス x
3.3.9.1.1. 命令マネージャー・ポート 3.3.9.1.2. データ・マネージャー・ポート
3.3.9.3. キャッシュメモリー x
3.3.9.3.1. 命令キャッシュ 3.3.9.3.2. データキャッシュ 3.3.9.3.3. コンフィグレーション可能なキャッシュメモリー 3.3.9.3.4. キャッシュのバイパス (ペリフェラル領域) 3.3.9.3.5. キャッシュメモリーの効果的な使用
3.3.10. RISC-Vベースのデバッグモジュール x
3.3.10.1. デバッグモード 3.3.10.2. デバッグモジュールからの停止 3.3.10.3. トリガー 3.3.10.4. デバッグモードの抽象コマンド 3.3.10.5. ハードウェア/ソフトウェア・インターフェイス
3.4. プログラミング・モデル x
3.4.1. 特権レベル 3.4.2. コントロール・ステータス・レジスター (CSR) のマッピング
3.4.1. 特権レベル x
3.4.1.1. マシンモード (Mモード) 3.4.1.2. デバッグモード (Dモード)
3.4.2. コントロール・ステータス・レジスター (CSR) のマッピング x
3.4.2.1. コントロール・ステータス・レジスターのフィールド
3.5. コアの実装 x
3.5.1. 命令セットのリファレンス
1. 概要
2. Nios® V/mプロセッサー
3. Nios® V/gプロセッサー
4. Nios Vプロセッサー・リファレンス・マニュアルのアーカイブ
5. Nios® Vプロセッサー・リファレンス・マニュアルの改訂履歴

3.4.2. コントロール・ステータス・レジスター (CSR) のマッピング

コントロール・ステータス・レジスターでは、ステータスを報告し、プロセッサーの動作を変更します。プロセッサー・コアでは、MモードとDモードのみをサポートするため、 Nios® V/gプロセッサーによって実装するCSRは、この2つのモードでサポートされるものになります。

表 63.  コントロール・ステータス・レジスターのリスト
番号 Privilege 名前 説明
Machine Information Register
0xF11 MRO mvendorid ベンダーIDです。ベンダーIDレジスターのフィールドを参照してください。
0xF12 MRO marchid アーキテクチャーIDです。アーキテクチャーIDレジスターのフィールドを参照してください。
0xF13 MRO mimpid 実装IDです。実装IDレジスターのフィールドを参照してください。
0xF14 MRO mhartid ハードウェア・スレッドID。ハードウェア・スレッドIDレジスターのフィールドを参照してください。
Machine Trap Setup
0x300 MRW mstatus マシン・ステータス・レジスターです。マシン・ステータス・レジスターのフィールドを参照してください。
0x301 MRW misa ISAおよび拡張機能です。マシンISAレジスターのフィールドを参照してください。
0x304 MRW mie マシン割り込みイネーブル・レジスターです。マシン割り込みイネーブル・レジスターのフィールドを参照してください。
0x305 MRW mtvec マシン・トラップ・ハンドラー・ベース・アドレスです。マシン・トラップ・ハンドラー・ベース・アドレス・レジスターのフィールドを参照してください。
Machine Trap Handling
0x341 MRW mepc マシン例外プログラムカウンターです。マシン例外プログラム・カウンター・レジスターのフィールドを参照してください。
0x342 MRW mcause マシントラップ要因です。マシン・トラップ・ステータス・レジスターのフィールドを参照してください。
0x343 MRW mtval マシンの不良アドレスまたは命令です。マシン・トラップ・ステータス・レジスターのフィールドを参照してください。
0x344 MRW mip マシン割り込み保留レジスターです。マシン割り込み保留レジスターのフィールドを参照してください。
Debug Mode Register
0x7B0 DRW dcsr デバッグ・コントロール・ステータス・レジスターです。デバッグ・コントロール・ステータス・レジスターのフィールドを参照してください。
0x7B1 DRW dpc デバッグ・プログラム・カウンターです。デバッグ・プログラム・カウンター・レジスターのフィールドを参照してください。
Trigger Register
0x7A0 MRW tselect トリガー選択です。トリガー選択レジスターのフィールドを参照してください。
0x7A1 MRW tdata1 (mcontrol) トリガーデータ1 (マッチ・コントロール) です。トリガーデータ1 (マッチ・コントロール) レジスターのフィールドを参照してください。
0x7A2 MRW tdata2 トリガーデータ2です。トリガー選択レジスターのフィールドを参照してください。
0x7A4 MRO tinfo トリガー情報です。トリガー情報レジスターのフィールドを参照してください。

セクションの内容
コントロール・ステータス・レジスターのフィールド

関連情報
レベル 2 の表題