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1. インテル® Stratix® 10コンフィグレーション・ユーザーガイド
2. インテル® Stratix® 10のコンフィグレーションについての詳細
3. インテル® Stratix® 10のコンフィグレーション・スキーム
4. デザインでのリセット・リリース・インテルFPGA IPの使用
5. リモート・システム・アップデート (RSU)
6. インテル® Stratix® 10のコンフィグレーション機能
7. インテル® Stratix® 10のデバッグガイド
8. インテル® Stratix® 10コンフィグレーション・ユーザーガイド・アーカイブ
9. インテル® Stratix® 10コンフィグレーション・ユーザーガイド改訂履歴
3.1.1. Avalon® -STコンフィグレーション・スキームのハードウェア・コンポーネントとファイルの種類
3.1.2. Avalon-STデバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイルの形式
3.1.5. Avalon-STシングルデバイス・コンフィグレーション
3.1.6. Avalon® -STコンフィグレーション・スキームに向けたデバッグ・ガイドライン
3.1.7. Avalon-ST x8におけるQSFの割り当て
3.1.8. Avalon-ST x16におけるQSFの割り当て
3.1.9. Avalon-ST x32におけるQSFの割り当て
3.1.10. Avalon® -STコンフィグレーション・スキームで使用するIP: インテルFPGAパラレル・フラッシュ・ローダー II IPコア
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルの種類
3.2.2. ASシングルデバイスのコンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーションのタイミング・パラメーター
3.2.5. 外部AS_DATAピンで許容される最大スキュー遅延に関するガイドライン
3.2.6. シリアル・フラッシュ・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリーのレイアウト
3.2.8. AS_CLK
3.2.9. アクティブ・シリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Primeのプログラミング手順
3.2.11. ASコンフィグレーション・スキームに向けたデバッグ・ガイドライン
3.2.12. ASにおけるQSFの割り当て
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5.4.2.3. コンフィグレーション・ポインター・ブロックのレイアウト
コンフィグレーション・ポインター・ブロックには、アプリケーション・イメージのリストが含まれています。イメージの1つが成功する、もしくはすべてのイメージが失敗するまでSDMはイメージを順次試行します。構造には次の情報が含まれます。
オフセット | サイズ (バイト) | 説明 |
---|---|---|
0x00 | 4 | マジックナンバー0x57789609 |
0x04 | 4 | ポインター・ブロック・ヘッダーのサイズ (このドキュメントの場合は0x18) |
0x08 | 4 | ポインターブロックのサイズ (このドキュメントの場合は4096) |
0x0C | 4 | 予約済み |
0x10 | 4 | イメージポインターへのオフセット (IPTAB) |
0x14 | 4 | イメージ・ポインター・スロットの数 (NSLOTS) |
0x18 | — | 予約済み |
IPTAB | 8 | 最初 (優先順位が最下位) のイメージ・ポインター・スロット |
8 | 2番目の (優先順位が2番目に低い) イメージ・ポインター・スロット | |
8 | … | |
8 | 最後 (最優先) のイメージポインター |
コンフィグレーション・ポインター・ブロックには、最大508のアプリケーション・イメージ・ポインターを含めることができます。実際の数は、NSLOTSでリストされます。一般的なコンフィグレーション・ポインター・ブロックの更新手順では、新しいポインターを追加し、場合によっては古いポインターをクリアーします。通常、ポインターブロックの更新には追加エントリーを1つ使用します。そのため、ポインターブロックの消去が要求されるまでに、508のリモート・システム・アップデートを行うことができます。消去手順は、ポインターブロックの圧縮と呼ばれます。この手順は安全です。ポインターブロックには2つのコピーがあります。コピーは異なるフラッシュ消去セクターにあります。1つのコピーが更新されている間も、もう一方のコピーは依然として有効です。