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3.1. ガイドライン : VREFソースとVREFピン
3.2. ガイドライン : 3.0 Vインターフェイスでのデバイスの絶対最大定格の観察
3.3. ガイドライン:電圧リファレンス形式および非電圧リファレンス形式のI/O規格
3.4. ガイドライン : パワーシーケンス中に I/O ピンをドライブしない
3.5. ガイドライン : 最大 DC 電流制限
3.6. ガイドライン: 3つのVI/Oバンクすべてに1つの電圧のみを使用
3.7. ガイドライン: インテル® Stratix® 10 TX 400のI/O規格の制限
3.8. ガイドライン: Intel® Stratix® 10 GX 400そしてSX 400のI/O規格の制限
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4.1.1. GPIO インテル® FPGA IPのリリース情報
IPバージョンは インテル® Quartus® Primeデザインスイートソフトウェアバージョンと同じです(最大v19.1まで)。 インテル® Quartus® Primeデザインスイートソフトウェアバージョン19.2以降、IPコアには新しいIPバージョン管理スキームがあります。
IPバージョン管理スキーム(XYZ)番号は、ソフトウェアバージョンによって異なります。
- XはIPのメジャーリビジョンを示します。インテルQuartus Primeソフトウェアを更新する場合は、IPを再生成する必要があります。
- Yは、IPに新しい機能が含まれていることを示します。これらの新機能を含めるためにIPを再生成します。
- Zは、IPに小さな変更が含まれていることを示します。これらの変更を含めるためにIPを再生成します。
項目 | 内容 |
---|---|
GNUのバージョン | 19.3.0 |
インテル® Quartus® Primeバージョン | 19.3 |
リリース時期 | 2019.09.30 |